參數資料
| 型號： | AD5582YRVZ |
| 廠商： | Analog Devices Inc |
| 文件頁數： | 4/20頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC 12BIT QUAD VOUT 48-TSSOP |
| 產品培訓模塊： | Data Converter Fundamentals DAC Architectures |
| 標準包裝： | 39 |
| 設置時間： | 5µs |
| 位數： | 12 |
| 數據接口： | 并聯 |
| 轉換器數目： | 4 |
| 電壓電源： | 模擬和數字，雙 ± |
| 功率耗散（最大）： | 30mW |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-TFSOP（0.240"，6.10mm 寬） |
| 供應商設備封裝： | 48-TSSOP |
| 包裝： | 管件 |
| 輸出數目和類型： | 4 電壓，單極；4 電壓，雙極 |
| 采樣率（每秒）： | 200k |
| 產品目錄頁面： | 783 (CN2011-ZH PDF) |
REV. A
–12–
AD5582/AD5583
CODE (Decimal)
1.0
0
512
1024
2048
4096
INL
(LSB)
0.2
–0.4
–1.0
1536
2560
0.4
0
–0.6
VDD = 5V
VSS = 5V
VREFH = 4V
VREFL = 0V
3584
0.8
–0.8
3072
0.6
–0.2
RL = NO LOAD
RL = 260
RL = 390
RL = 790
RESISTIVE LOAD RL IS BETWEEN
VOUT AND GND
TPC 7. AD5582 INL at Various Resistive Loads
CODE (Decimal)
0.5
0
512
1024
2048
4096
DNL
(LSB)
0.1
–0.2
–0.5
1536
2560
0.2
0
–0.3
VDD = 5V
VSS = 5V
VREFH = 4V
VREFL = 0V
3584
0.4
–0.4
3072
0.3
–0.1
RESISTIVE LOAD RL IS BETWEEN
VOUT AND GND
RL = NO LOAD
RL = 260
TPC 8. AD5582 DNL at Various Resistive Loads
RL ( )
0
100
1k
100k
GAIN
ERR
OR
(LSB)
–10
–16
–12
10k
–14
–8
RESISTIVE LOAD RL IS BETWEEN
VOUT AND GND
–4
–6
–2
VDD = +5V OR +15V
VSS = –5V OR 0V
VREFH = +4V
VREFL = 0V
VDD = +15V
VSS = 0V
VREFH = +10V
VREFL = 0V
TPC 9. AD5582 Gain Error vs. Resistive Load
RL_PU ( )
40
100
1k
1M
ERR
OR
(LSB)
–10
–40
–20
10k
–30
0
PULL-UP RESISTIVE LOAD RL
IS BETWEEN V DD AND VOUT
20
10
30
100k
ZERO
SCALE
ERROR
VREFL = VSS
VREFL > VSS
GAIN
ERROR
GAIN
ERROR
ZERO
SCALE
ERROR
TPC 10. AD5582 Gain and Zero-Scale Error vs.
Pull-Up Resistive Loads
VREFH – VREFL (V)
5.0
02
12
LINEARITY
ERR
OR
(LSB)
2.5
0
1.5
6
0.5
3.0
4.0
3.5
4.5
10
INL
8
4
2.0
1.0
DNL
TPC 11. AD5582 Linearity Errors vs. Differential
Reference Ranges
VDD (V)
2.00
02
16
I DD
(mA) 1.75
1.50
1.65
6
1.55
1.80
1.90
1.85
1.95
12
8
4
1.70
1.60
14
10
VSS = 0V
VREFH = +4V
VREFL = 0V
VDD = +5V
VSS = –5V
VREFH = +4V
TPC 12. AD5582 Supply Current vs. Supply Voltage
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