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參數資料
| 型號： | AD6655-150EBZ1 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | IF Diversity Receiver |
| 中文描述： | IF分集接收機 |
| 文件頁數： | 49/84頁 |
| 文件大小： | 2012K |
| 代理商： | AD6655-150EBZ1 |
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AD6655
CONFIGURATION WITHOUT THE SPI
In applications that do not interface to the SPI control registers,
the SDIO/DCS pin, the SCLK/DFS pin, the SMI SDO/OEB pin,
and the SMI SCLK/PDWN pin serve as standalone CMOS-
compatible control pins. When the device is powered up, it is
assumed that the user intends to use the pins as static control
lines for the duty cycle stabilizer, output data format, output
enable, and power-down feature control. In this mode, the CSB
chip select should be connected to AVDD, which disables the
serial port interface.
Rev. 0 | Page 49 of 84
Table 27. Mode Selection
Pin
SDIO/DCS
External
Voltage
AVDD (default)
Configuration
Duty cycle stabilizer
enabled
Duty cycle stabilizer
disabled
Twos complement
enabled
Offset binary enabled
Outputs in high
impedance
Outputs enabled
Chip in power-down or
standby
Normal operation
AGND
AVDD
SCLK/DFS
AGND (default)
AVDD
SMI SDO/OEB
AGND (default)
AVDD
SMI SCLK/PDWN
AGND (default)
SPI ACCESSIBLE FEATURES
Table 28 provides a brief description of the general features that
are accessible via the SPI. These features are described in detail
in Application Note AN-877,
Interfacing to High Speed ADCs via
SPI
(see
www.analog.com
). The AD6655 part-specific features
are described in the Memory Map Register Description section.
Table 28. Features Accessible Using the SPI
Feature Name
Description
Mode
Allows the user to set either power-down mode
or standby mode
Clock
Allows the user to access the DCS via the SPI
Offset
Allows the user to digitally adjust the
converter offset
Test I/O
Allows the user to set test modes to have
known data on output bits
Output Mode
Allows the user to set up outputs
Output Phase
Allows the user to set the output clock polarity
Output Delay
Allows the user to vary the DCO delay
VREF
Allows the user to set the reference voltage
DON’T CARE
DON’T CARE
DON’T CARE
DON’T CARE
SDIO
SCLK
CSB
t
S
t
DH
t
CLK
t
DS
t
H
R/W
W1
W0
A12
A11
A10
A9
A8
A7
D5
D4
D3
D2
D1
D0
t
LOW
t
HIGH
0
Figure 81. Serial Port Interface Timing Diagram
相關PDF資料 |
PDF描述 |
|---|---|
| AD6655BCPZ-1051 | IF Diversity Receiver |
| AD6655BCPZ-1501 | IF Diversity Receiver |
| AD6655BCPZ-801 | IF Diversity Receiver |
| AD667JN | Microprocessor-Compatible 12-Bit D/A Converter |
| AD667JP | Microprocessor-Compatible 12-Bit D/A Converter |
相關代理商/技術參數 |
參數描述 |
|---|---|
| AD6655ABCPZ-105 | 功能描述:IC IF RCVR 14BIT 105MSPS 64LFCSP RoHS:是 類別:RF/IF 和 RFID >> RF 其它 IC 和模塊 系列:- 標準包裝:100 系列:* |
| AD6655ABCPZ-125 | 功能描述:IC IF RCVR 14BIT 125MSPS 64LFCSP RoHS:是 類別:RF/IF 和 RFID >> RF 其它 IC 和模塊 系列:- 標準包裝:100 系列:* |
| AD6655ABCPZ-150 | 功能描述:IC IF RCVR 14BIT 150MSPS 64LFCSP RoHS:是 類別:RF/IF 和 RFID >> RF 其它 IC 和模塊 系列:- 標準包裝:100 系列:* |
| AD6655ABCPZ-80 | 功能描述:IC IF RCVR 14BIT 80MSPS 64LFCSP RoHS:是 類別:RF/IF 和 RFID >> RF 其它 IC 和模塊 系列:- 標準包裝:100 系列:* |
| AD6655ABCPZRL7-125 | 功能描述:IC IF RCVR 14BIT 125MSPS 64LFCSP RoHS:是 類別:RF/IF 和 RFID >> RF 其它 IC 和模塊 系列:- 標準包裝:100 系列:* |
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