VDD1 = 4.5 V to 5.5 V, V
參數(shù)資料
型號: AD7401AYRWZ
廠商: Analog Devices Inc
文件頁數(shù): 16/20頁
文件大?。?/td> 0K
描述: IC MODULATOR SIGMA-DELTA 16SOIC
標準包裝: 47
位數(shù): 16
采樣率(每秒): 20M
數(shù)據(jù)接口: 串行
轉(zhuǎn)換器數(shù)目: 1
功率耗散(最大): 93.5mW
電壓電源: 單電源
工作溫度: -40°C ~ 125°C
安裝類型: 表面貼裝
封裝/外殼: 16-SOIC(0.295",7.50mm 寬)
供應商設備封裝: 16-SOIC W
包裝: 管件
輸入數(shù)目和類型: 1 個差分,雙極
產(chǎn)品目錄頁面: 798 (CN2011-ZH PDF)
AD7401A
Rev. C | Page 5 of 20
TIMING SPECIFICATIONS
VDD1 = 4.5 V to 5.5 V, VDD2 = 3 V to 5.5 V, TA = 40°C to +125°C, unless otherwise noted.
Table 2.
Limit at TMIN, TMAX
Unit
Description
20
MHz max
Master clock input frequency
5
MHz min
Master clock input frequency
25
ns max
Data access time after MCLKIN rising edge
15
ns min
Data hold time after MCLKIN rising edge
t3
0.4 × tMCLKIN
ns min
Master clock low time
t4
0.4 × tMCLKIN
ns min
Master clock high time
1 Sample tested during initial release to ensure compliance.
2 Mark space ratio for clock input is 40/60 to 60/40 for fMCLKIN ≤ 16 MHz and 48/52 to 52/48 for 16 MHz < fMCLKIN < 20 MHz.
3 VDD1 = VDD2 = 5 V
± 5% for fMCLKIN > 16 MHz to 20 MHz.
4 Measured with the load circuit of
and defined as the time required for the output to cross 0.8 V or 2.0 V.
200A
IOL
200A
IOH
1.6V
TO OUTPUT
PIN
CL
25pF
07
33
2-
00
2
Figure 2. Load Circuit for Digital Output Timing Specifications
MCLKIN
MDAT
t1
t2
t4
t3
07
33
2-
00
3
Figure 3. Data Timing
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PDF描述
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參數(shù)描述
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AD7401BRW 制造商:Analog Devices 功能描述:
AD7401YRW 制造商:Analog Devices 功能描述:
AD7401YRW-REEL 功能描述:INTEGRATED CIRCUIT 制造商:analog devices inc. 系列:* 包裝:帶卷(TR) 零件狀態(tài):最後搶購 安裝類型:表面貼裝 封裝/外殼:16-SOIC(0.295",7.50mm 寬) 供應商器件封裝:16-SOIC 標準包裝:1
AD7401YRWZ 功能描述:IC MODULATOR SIGMA-DELTA 16SOIC RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉(zhuǎn)換器 系列:- 標準包裝:1,000 系列:- 位數(shù):16 采樣率(每秒):45k 數(shù)據(jù)接口:串行 轉(zhuǎn)換器數(shù)目:2 功率耗散(最大):315mW 電壓電源:模擬和數(shù)字 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SOIC(0.295",7.50mm 寬) 供應商設備封裝:28-SOIC W 包裝:帶卷 (TR) 輸入數(shù)目和類型:2 個單端,單極