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參數(shù)資料
| 型號： | AD7866BRU |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 19/24頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC ADC 12BIT 2CH DUAL 20-TSSOP |
| 標準包裝： | 1 |
| 位數(shù)： | 12 |
| 采樣率（每秒）： | 1M |
| 數(shù)據(jù)接口： | DSP，MICROWIRE?，QSPI?，串行，SPI? |
| 轉換器數(shù)目： | 2 |
| 功率耗散（最大）： | 24mW |
| 電壓電源： | 模擬和數(shù)字 |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 20-TSSOP |
| 包裝： | 管件 |
| 輸入數(shù)目和類型： | 4 個單端，單極 |
| 配用： | EVAL-AD7866CBZ-ND - BOARD EVALUATION AD7866 |
REV. A
–4–
AD7866
TIMING SPECIFICATIONS1(V
DD = 2.7 V to 5.25 V, VDRIVE = 2.7 V to 5.25 V, VREF = 2.5 V; TA = TMIN to TMAX, unless otherwise noted.)
Limit at
Parameter
TMIN, TMAX
Unit
Description
fSCLK
2
10
kHz min
20
MHz max
tCONVERT
16
tSCLK
ns max
tSCLK = 1/fSCLK
800
ns max
fSCLK = 20 MHz
tQUIET
50
ns max
Minimum Time between End of Serial Read and Next Falling Edge of
CS
t2
10
ns min
CS to SCLK Setup Time
t3
3
25
ns max
Delay from
CS until D
OUTA and DOUTB Three-State Disabled
t4
3
40
ns max
Data Access Time after SCLK Falling Edge. VDRIVE
3 V, CL = 50 pF;
VDRIVE < 3 V, CL = 25 pF
t5
0.4 tSCLK
ns min
SCLK Low Pulsewidth
t6
0.4 tSCLK
ns min
SCLK High Pulsewidth
t7
10
ns min
SCLK to Data Valid Hold Time
t8
4
25
ns max
CS Rising Edge to D
OUTA, DOUTB, High Impedance
t9
4
10
ns min
SCLK Falling Edge to DOUTA, DOUTB, High Impedance
50
ns max
SCLK Falling Edge to DOUTA, DOUTB, High Impedance
NOTES
1Sample tested at 25
°C to ensure compliance. All input signals are specified with t
R = tF = 5 ns (10% to 90% of VDRIVE) and timed from a voltage level of 1.6 V.
2Mark/Space ratio for the CLK input is 40/60 to 60/40.
3Measured with the load circuit of Figure 1 and defined as the time required for the output to cross 0.8 V or 2.0 V.
4t
8, t9 are derived from the measured time taken by the data outputs to change 0.5 V when loaded with the circuit of Figure 1. The measured number is then extrapo-
lated back to remove the effects of charging or discharging the 50 pF capacitor. This means that the times t8 and t9 quoted in the timing characteristics are the true
bus relinquish times of the part and are independent of the bus loading.
Specifications subject to change without notice.
1.6V
200 AIOL
200 A
IOH
CL
50pF
TO
OUTPUT
PIN
Figure 1. Load Circuit for Digital Output Timing Specifications
相關PDF資料 |
PDF描述 |
|---|---|
| CXC3106A12S3S | CONN PLUG 2POS STRGHT SKT |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| AD7866BRU-REEL | 制造商:Analog Devices 功能描述:ADC Dual SAR 1Msps 12-bit Serial 20-Pin TSSOP T/R |
| AD7866BRU-REEL7 | 功能描述:IC ADC 12BIT 2CH DUAL 20TSSOP RoHS:否 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉換器 系列:- 標準包裝:1,000 系列:- 位數(shù):12 采樣率（每秒）:300k 數(shù)據(jù)接口:并聯(lián) 轉換器數(shù)目:1 功率耗散（最大）:75mW 電壓電源:單電源 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:24-SOIC（0.295"，7.50mm 寬） 供應商設備封裝:24-SOIC 包裝:帶卷 (TR) 輸入數(shù)目和類型:1 個單端，單極；1 個單端，雙極 |
| AD7866BRUZ | 功能描述:IC ADC 12BIT 2CH DUAL 20-TSSOP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉換器 系列:- 標準包裝:1 系列:microPOWER™ 位數(shù):8 采樣率（每秒）:1M 數(shù)據(jù)接口:串行，SPI? 轉換器數(shù)目:1 功率耗散（最大）:- 電壓電源:模擬和數(shù)字 工作溫度:-40°C ~ 125°C 安裝類型:表面貼裝 封裝/外殼:24-VFQFN 裸露焊盤 供應商設備封裝:24-VQFN 裸露焊盤（4x4） 包裝:Digi-Reel® 輸入數(shù)目和類型:8 個單端，單極 產品目錄頁面:892 (CN2011-ZH PDF) 其它名稱:296-25851-6 |
| AD7866BRUZ-REEL | 功能描述:IC ADC 12BIT 2CHAN DUAL 20TSSOP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉換器 系列:- 標準包裝:1,000 系列:- 位數(shù):16 采樣率（每秒）:45k 數(shù)據(jù)接口:串行 轉換器數(shù)目:2 功率耗散（最大）:315mW 電壓電源:模擬和數(shù)字 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SOIC（0.295"，7.50mm 寬） 供應商設備封裝:28-SOIC W 包裝:帶卷 (TR) 輸入數(shù)目和類型:2 個單端，單極 |
| AD7866BRUZ-REEL7 | 功能描述:IC ADC 12BIT 2CHAN DUAL 20TSSOP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉換器 系列:- 標準包裝:1,000 系列:- 位數(shù):16 采樣率（每秒）:45k 數(shù)據(jù)接口:串行 轉換器數(shù)目:2 功率耗散（最大）:315mW 電壓電源:模擬和數(shù)字 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SOIC（0.295"，7.50mm 寬） 供應商設備封裝:28-SOIC W 包裝:帶卷 (TR) 輸入數(shù)目和類型:2 個單端，單極 |
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