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參數(shù)資料
| 型號： | AD800-52BRZRL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 12/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK\DATA RECOVERY PLL 20SOIC |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 類型： | 時鐘和數(shù)據(jù)恢復(fù)（CDR），扇出緩沖器（分配） |
| PLL： | 是 |
| 主要目的： | DS-3，STS-1 |
| 輸入： | ECL |
| 輸出： | ECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 51.84MHz |
| 電源電壓： | -4.5 V ~ -5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-SOIC（0.295"，7.50mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 20-SOIC W |
| 包裝： | 帶卷 (TR) |
AD800/AD802
REV. B
–9–
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
DATAOUT
VCC2
CLKOUT
AVEE
ASUBST
FRAC
SUBST
DATAIN
AVCC
CF1
CF2
DATAOUT
CLKOUT
Z1
AD800/802
J1
J2
R1
R2
R5 100
R10
R6 100
5.0V
R9
R12
R11
R7 100
R8 100
R3
R4
J3
J4
C10
0.1
100
154
CD
R22
80.6
R21
80.6
R19
130
R20
130
FRAC
5.0V
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
Z2
10H116
R24
130
R23
130
J5
J6
R26
80.6
R25
80.6
DATAIN
5.0V
0.1
C7 0.1
C6 0.1
0.1
C16
5.0V
R16 100
5.0V
C13 0.1
100
154
0.1
C20
C21 0.1
5.0V
C8
C9
0.1
C5
C4
C3
R13
R14
R15 100
R17
R18
C17 0.1
C14 0.1
C15 0.1
0.1
C12
C11
C19
0.1
VEE
C2
10
F
5.0V
BYPASS
NETWORK
OUT
IN
VEE
VCC1
VEE
VCC1
Figure 22. Evaluation Board Schematic, Positive Supply
Table I. Evaluation Board, Positive Supply: Components List
Reference
Designator
Description
Quantity
R1–8, R15–18
Resistor, 100
, 1%
12
R9–14
Resistor, 154
, 1%
6
R19, 20, 23, 24
Resistor, 130
, 1%
4
R21, 22, 25, 26
Resistor, 80.6
, 1%
4
CD
Capacitor, Loop Damping (See Specifications Page)
1
C2
Capacitor, 10
F, Tantalum
1
C3–C21
Capacitor, 0.1
F, Ceramic Chip
17
Z1
AD800/AD802
1
Z2
10H116, ECL Line Receiver
1
IN
0.1
F
C2
10
F
BYPASS
NETWORK
(A, B, C,
OR D)
TO DEVICE
IN
5.0V
BEADS WITH ONE LOOP
IN
0.1
F
TO
DEVICE
TO
DEVICE
(A)
IN
0.1
F
TO
DEVICE
BEAD WITH
ONE LOOP
(B)
(C)
BEAD WITH
TWO LOOPS
IN
0.1
F
TO
DEVICE
BEAD WITH
TWO LOOPS
(D)
BEAD WITH
TWO LOOPS
BYPASS NETWORK
COMPONENTS:
CAPACITOR ..........CERAMIC CHIP
FERRITE BEAD......1/4 IN. STACKPOLE CARBO 57-1392
3.0
0
1.0
1.5
0.5
0.1
1.0
0
2.5
2.0
0.9
0.7
0.6
0.5
0.8
0.4
0.3
0.2
JITTER
–
ns
p-p
NOISE – V p-p @ 311MHz
(A)
(B)
(C)
(D)
Figure 23. Bypass Network Schemes
Figure 24. AD802-155 Output Jitter vs. Supply Noise
(PECL Configuration)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VI-200-MX-F2 | CONVERTER MOD DC/DC 5V 75W |
| VE-JWW-MW-B1 | CONVERTER MOD DC/DC 5.5V 100W |
| D38999/20WJ24PB | CONN RCPT 24POS WALL MNT W/PINS |
| ADN2815ACPZ-500RL7 | IC CLK/DATA REC 1.25GBPS 32LFCSP |
| MS27497E24B35SC | CONN RCPT 128POS WALL MNT W/SCKT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AD80052KBC-45 | 制造商:Analog Devices 功能描述: |
| AD80052KBCRL-45 | 制造商:Analog Devices 功能描述: |
| AD80053KBC-45 | 制造商:Analog Devices 功能描述: |
| AD80053KBCRL-45 | 制造商:Analog Devices 功能描述: |
| AD80053KST-36 | 制造商:Analog Devices 功能描述: |
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