參數(shù)資料
型號： AD9516-3BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 53/80頁
文件大?。?/td> 0K
描述： IC CLOCK PLL/VCO 2GHZ 64LFCSP
標(biāo)準(zhǔn)包裝： 1
類型： 時鐘發(fā)生器，扇出配送
PLL： 是
輸入： 時鐘
輸出： CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 1:14
差分 - 輸入:輸出： 是/是
頻率 - 最大： 2.25GHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 托盤
產(chǎn)品目錄頁面： 776 (CN2011-ZH PDF)
配用： AD9516-3/PCBZ-ND - BOARD EVAL FOR AD9516-3 2.0GHZ
Data Sheet
AD9516-3
Rev. C | Page 57 of 80
Reg.
Addr.
(Hex)
Parameter
Bit 7 (MSB)
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0 (LSB)
Default
Value
(Hex)
0x144
to
0x18F
Blank
LVPECL Channel Dividers
0x190
Divider 0
(PECL)
Divider 0 low cycles
Divider 0 high cycles
0x00
0x191
Divider 0
bypass
Divider 0
no sync
Divider 0
force high
Divider 0
start high
Divider 0 phase offset
0x80
0x192
Blank
Reserved
Divider 0
direct to
output
Divider 0
DCCOFF
0x00
0x193
Divider 1
(PECL)
Divider 1 low cycles
Divider 1 high cycles
0xBB
0x194
Divider 1
bypass
Divider 1
no sync
Divider 1
force high
Divider 1
start high
Divider 1 phase offset
0x00
0x195
Blank
Reserved
Divider 1
direct to
output
Divider 1
DCCOFF
0x00
0x196
Divider 2
(PECL)
Divider 2 low cycles
Divider 2 high cycles
0x00
0x197
Divider 2
bypass
Divider 2
no sync
Divider 2
force high
Divider 2
start high
Divider 2 phase offset
0x00
0x198
Blank
Reserved
Divider 2
direct to
output
Divider 2
DCCOFF
0x00
LVDS/CMOS Channel Dividers
0x199
Divider 3
(LVDS/CMOS)
Low Cycles Divider 3.1
High Cycles Divider 3.1
0x22
0x19A
Phase Offset Divider 3.2
Phase Offset Divider 3.1
0x00
0x19B
Low Cycles Divider 3.2
High Cycles Divider 3.2
0x11
0x19C
Reserved
Bypass
Divider 3.2
Bypass
Divider 3.1
Divider 3
no sync
Divider 3
force high
Start High
Divider 3.2
Start High
Divider 3.1
0x00
0x19D
Blank
Reserved
Divider 3
DCCOFF
0x00
0x19E
Divider 4
(LVDS/CMOS)
Low Cycles Divider 4.1
High Cycles Divider 4.1
0x22
0x19F
Phase Offset Divider 4.2
Phase Offset Divider 4.1
0x00
0x1A0
Low Cycles Divider 4.2
High Cycles Divider 4.2
0x11
0x1A1
Reserved
Bypass
Divider 4.2
Bypass
Divider 4.1
Divider 4
no sync
Divider 4
force high
Start High
Divider 4.2
Start High
Divider 4.1
0x00
0x1A2
Blank
Reserved
Divider 4
DCCOFF
0x00
0x1A3
Reserved
0x1A4
to
0x1DF
Blank
VCO Divider and CLK Input
0x1E0
VCO divider
Blank
Reserved
VCO Divider
0x02
0x1E1
Input CLKs
Reserved
Power-
down
clock input
section
Power-down
VCO clock
interface
Power-
down VCO
and CLK
Select
VCO or CLK
Bypass VCO
divider
0x00
0x1E2
to
0x22A
Blank
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PDF描述
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