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參數(shù)資料
| 型號： | AD9752ARZRL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 21/23頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC 12BIT 125MSPS 28SOIC |
| 產(chǎn)品培訓模塊： | Data Converter Fundamentals DAC Architectures |
| 標準包裝： | 1,000 |
| 系列： | TxDAC® |
| 設置時間： | 35ns |
| 位數(shù)： | 12 |
| 數(shù)據(jù)接口： | 并聯(lián) |
| 轉(zhuǎn)換器數(shù)目： | 1 |
| 電壓電源： | 模擬和數(shù)字 |
| 功率耗散（最大）： | 220mW |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-SOIC（0.295"，7.50mm 寬） |
| 供應商設備封裝： | 28-SOIC W |
| 包裝： | 帶卷 (TR) |
| 輸出數(shù)目和類型： | 2 電流，單極；2 電流，雙極 |
| 采樣率（每秒）： | 125M |
REV. 0
AD9752
–7–
Typical AC Characterization Curves @ +5 V Supplies
(AVDD = +5 V, DVDD = +5 V, IOUTFS = 20 mA, 50
Doubly Terminated Load, Differential Output, TA = +25 C, SFDR up to Nyquist, unless otherwise noted)
fOUT – MHz
SFDR
–
dB
90
80
40
0
1
100
10
70
60
50
25MSPS
50MSPS
125MSPS
65MSPS
Figure 3. SFDR vs. fOUT @ 0 dBFS
fOUT – MHz
SFDR
–
dBc
90
80
40
0
530
20
70
60
50
10
15
25
–12dBFS
–6dBFS
0dBFS
Figure 6. SFDR vs. fOUT @ 65 MSPS
AOUT – dBFS
SFDR
–
dB
90
70
–30
–25
0
–10
80
–20
–15
–5
40
60
50
2.27MHz@25MSPS
4.55MHz@50MSPS
5.91MHz@65MSPS
11.36MHz@125MSPS
Figure 9. Single-Tone SFDR vs. AOUT
@ fOUT = fCLOCK/11
SFDR
–
dB
90
80
40
0
214
12
70
60
50
46
8
10
–12dBFS
0dBFS
–6dBFS
fOUT – MHz
Figure 4. SFDR vs. fOUT @ 25 MSPS
SFDR
–
dB
90
80
40
0
10
60
40
70
60
50
20
30
50
–6dBFS
0dBFS
–12dBFS
fOUT – MHz
Figure 7. SFDR vs. fOUT @ 125 MSPS
AOUT – dBFS
SFDR
–
dB
90
70
–30
–25
0
–10
80
–20
–15
–5
40
60
50
5MHz@25MSPS
10MHz@50MSPS
13MHz@65MSPS
25MHz@125MSPS
Figure 10. Single-Tone SFDR vs.
AOUT @ fOUT = fCLOCK/5
fOUT – MHz
SFDR
–
dBc
90
80
40
05
25
10
70
60
50
15
20
–12dBFS
–6dBFS
0dBFS
Figure 5. SFDR vs. fOUT @ 50 MSPS
fOUT – MHz
SFDR
–
dBc
90
0
212
8
80
70
46
10
50
60
10mA FS
20mA FS
5mA FS
Figure 8. SFDR vs. fOUT and IOUTFS
@ 25 MSPS and 0 dBFS
fCLOCK – MSPS
SNR
–
dB
0
20
120
80
40
60
100
60
70
50
20mA FS
10mA FS
5mA FS
Figure 11. SNR vs. fCLOCK and IOUTFS
@ fOUT = 2 MHz and 0 dBFS
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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