參數(shù)資料
型號(hào)： AD9765ASTZRL
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 2/44頁(yè)
文件大?。?/td> 0K
描述： IC DAC 12BIT DUAL 125MSPS 48LQFP
產(chǎn)品培訓(xùn)模塊： Data Converter Fundamentals
DAC Architectures
標(biāo)準(zhǔn)包裝： 2,000
系列： TxDAC+®
設(shè)置時(shí)間： 35ns
位數(shù)： 12
數(shù)據(jù)接口： 并聯(lián)
轉(zhuǎn)換器數(shù)目： 2
電壓電源： 模擬和數(shù)字
功率耗散（最大）： 450mW
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 帶卷 (TR)
輸出數(shù)目和類(lèi)型： 4 電流，單極；4 電流，雙極
采樣率（每秒）： 125M
配用： AD9765-EBZ-ND - BOARD EVAL FOR AD9765
AD9763/AD9765/AD9767
Data Sheet
Rev. G | Page 10 of 44
Table 6. Pin Function Descriptions
Pin No.
AD9763
AD9765
AD9767
Mnemonic
Description
1 to 10
1 to 12
1 to 14
DBxP1
Data Bit Pins (Port 1)
11 to 14,
33 to 36
13, 14,
35, 36
N/A
NC
No Connect
15, 21
DCOM1, DCOM2
Digital Common
16, 22
DVDD1, DVDD2
Digital Supply Voltage
17
WRT1/IQWRT
Input Write Signal for PORT 1 (IQWRT in Interleaving Mode)
18
CLK1/IQCLK
Clock Input for DAC1 (IQCLK in Interleaving Mode)
19
CLK2/IQRESET
Clock Input for DAC2 (IQRESET in Interleaving Mode)
20
WRT2/IQSEL
Input Write Signal for PORT 2 (IQSEL in Interleaving Mode)
23 to 32
23 to 34
23 to 36
DBxP2
Data Bit Pins (Port 2)
37
SLEEP
Power-Down Control Input
38
ACOM
Analog Common
39, 40
IOUTA2, IOUTB2
Port 2 Differential DAC Current Outputs
41
FSADJ2
Full-Scale Current Output Adjust for DAC2
42
GAINCTRL
Master/Slave Resistor Control Mode
43
REFIO
Reference Input/Output
44
FSADJ1
Full-Scale Current Output Adjust for DAC1
45, 46
IOUTB1, IOUTA1
Port 1 Differential DAC Current Outputs
47
AVDD
Analog Supply Voltage
48
MODE
Mode Select (1 = dual port, 0 = interleaved)
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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