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NXP Semiconductors
ADC1115S125
11-bit, 125 Msps ADC; input buffer; CMOS or LVDS DDR digital outputs
NXP B.V. 2010.
All rights reserved.
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Date of release: 17 December 2010
Document identifier: ADC1115S125
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16. Contents
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3
4
5
6
6.1
6.2
7
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9
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10.1
10.2
10.3
10.4
11
11.1
11.1.1
11.1.2
11.1.3
11.1.4
11.2
11.2.1
11.2.2
11.3
11.3.1
11.3.2
11.3.3
11.3.4
11.4
11.4.1
11.4.2
11.4.3
11.4.4
11.5
11.5.1
11.5.2
11.5.3
11.5.4
11.5.5
11.5.6
11.5.7
11.6
11.6.1
11.6.2
General description. . . . . . . . . . . . . . . . . . . . . . 1
Features and benefits . . . . . . . . . . . . . . . . . . . . 1
Applications . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2
Ordering information. . . . . . . . . . . . . . . . . . . . . 2
Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . 2
Pinning information. . . . . . . . . . . . . . . . . . . . . . 3
Pinning . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
Pin description . . . . . . . . . . . . . . . . . . . . . . . . . 3
Limiting values. . . . . . . . . . . . . . . . . . . . . . . . . . 5
Thermal characteristics . . . . . . . . . . . . . . . . . . 5
Static characteristics. . . . . . . . . . . . . . . . . . . . . 5
Dynamic characteristics . . . . . . . . . . . . . . . . . . 8
Dynamic characteristics . . . . . . . . . . . . . . . . . . 8
Clock and digital output timing . . . . . . . . . . . . . 9
SPI timings . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
Typical characteristics . . . . . . . . . . . . . . . . . . 12
Application information. . . . . . . . . . . . . . . . . . 13
Device control. . . . . . . . . . . . . . . . . . . . . . . . . 13
SPI and Pin control modes. . . . . . . . . . . . . . . 13
Operating mode selection. . . . . . . . . . . . . . . . 14
Selecting the output data standard. . . . . . . . . 14
Selecting the output data format. . . . . . . . . . . 14
Analog inputs . . . . . . . . . . . . . . . . . . . . . . . . . 14
Input stage . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
Transformer . . . . . . . . . . . . . . . . . . . . . . . . . . 16
System reference and power management . . 17
Internal/external references . . . . . . . . . . . . . . 17
Programmable full-scale. . . . . . . . . . . . . . . . . 18
Common-mode output voltage (V
O(cm)
) . . . . . 18
Biasing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Clock input . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
Drive modes . . . . . . . . . . . . . . . . . . . . . . . . . 19
Equivalent input circuit . . . . . . . . . . . . . . . . . . 20
Duty cycle stabilizer . . . . . . . . . . . . . . . . . . . . 20
Clock input divider . . . . . . . . . . . . . . . . . . . . . 20
Digital outputs. . . . . . . . . . . . . . . . . . . . . . . . . 21
Digital output buffers: CMOS mode . . . . . . . . 21
Digital output buffers: LVDS DDR mode. . . . . 22
DAta Valid (DAV) output clock . . . . . . . . . . . . 23
Out-of-Range (OTR). . . . . . . . . . . . . . . . . . . . 23
Digital offset . . . . . . . . . . . . . . . . . . . . . . . . . . 23
Test patterns. . . . . . . . . . . . . . . . . . . . . . . . . . 23
Output codes versus input voltage . . . . . . . . . 24
Serial Peripheral Interface (SPI). . . . . . . . . . . 24
Register description . . . . . . . . . . . . . . . . . . . . 24
Default modes at start-up . . . . . . . . . . . . . . . . 25
11.6.3
12
13
14
14.1
14.2
14.3
14.4
15
16
Register allocation map . . . . . . . . . . . . . . . . . 27
Package outline. . . . . . . . . . . . . . . . . . . . . . . . 34
Revision history . . . . . . . . . . . . . . . . . . . . . . . 35
Legal information . . . . . . . . . . . . . . . . . . . . . . 36
Data sheet status. . . . . . . . . . . . . . . . . . . . . . 36
Definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
Disclaimers . . . . . . . . . . . . . . . . . . . . . . . . . . 36
Trademarks . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Contact information . . . . . . . . . . . . . . . . . . . . 37
Contents. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38