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NXP Semiconductors
ADC1210S series
Single 12-bit ADC; CMOS or LVDS DDR digital outputs
NXP B.V. 2010.
All rights reserved.
For more information, please visit: http://www.nxp.com
For sales office addresses, please send an email to: salesaddresses@nxp.com
Date of release: 23 December 2010
Document identifier: ADC1210S_SER
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16. Contents
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6
6.1
6.2
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11.1.1
11.1.2
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11.1.4
11.2
11.2.1
11.2.2
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11.4.4
11.5
11.5.1
11.5.2
11.5.3
11.5.4
11.5.5
11.5.6
11.5.7
11.6
11.6.1
General description. . . . . . . . . . . . . . . . . . . . . . 1
Features and benefits . . . . . . . . . . . . . . . . . . . . 1
Applications . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1
Ordering information. . . . . . . . . . . . . . . . . . . . . 2
Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . 2
Pinning information. . . . . . . . . . . . . . . . . . . . . . 3
Pinning . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
Pin description . . . . . . . . . . . . . . . . . . . . . . . . . 3
Limiting values. . . . . . . . . . . . . . . . . . . . . . . . . . 5
Thermal characteristics . . . . . . . . . . . . . . . . . . 5
Static characteristics. . . . . . . . . . . . . . . . . . . . . 6
Dynamic characteristics . . . . . . . . . . . . . . . . . . 8
Dynamic characteristics . . . . . . . . . . . . . . . . . . 8
Clock and digital output timing . . . . . . . . . . . . . 9
SPI timings . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
Typical characteristics . . . . . . . . . . . . . . . . . . 13
Application information. . . . . . . . . . . . . . . . . . 15
Device control. . . . . . . . . . . . . . . . . . . . . . . . . 15
SPI and Pin control modes. . . . . . . . . . . . . . . 15
Operating mode selection. . . . . . . . . . . . . . . . 15
Selecting the output data standard. . . . . . . . . 15
Selecting the output data format. . . . . . . . . . . 16
Analog inputs . . . . . . . . . . . . . . . . . . . . . . . . . 16
Input stage . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
Anti-kickback circuitry. . . . . . . . . . . . . . . . . . . 16
Transformer . . . . . . . . . . . . . . . . . . . . . . . . . . 17
System reference and power management . . 18
Internal/external references . . . . . . . . . . . . . . 18
Programmable full-scale. . . . . . . . . . . . . . . . . 20
Common-mode output voltage (V
O(cm)
) . . . . . 21
Biasing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
Clock input . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
Drive modes . . . . . . . . . . . . . . . . . . . . . . . . . 21
Equivalent input circuit . . . . . . . . . . . . . . . . . . 22
Duty cycle stabilizer . . . . . . . . . . . . . . . . . . . . 23
Clock input divider . . . . . . . . . . . . . . . . . . . . . 23
Digital outputs. . . . . . . . . . . . . . . . . . . . . . . . . 23
Digital output buffers: CMOS mode . . . . . . . . 23
Digital output buffers: LVDS DDR mode. . . . . 24
DAta Valid (DAV) output clock . . . . . . . . . . . . 25
Out-of-Range (OTR). . . . . . . . . . . . . . . . . . . . 25
Digital offset . . . . . . . . . . . . . . . . . . . . . . . . . . 25
Test patterns. . . . . . . . . . . . . . . . . . . . . . . . . . 25
Output codes versus input voltage . . . . . . . . . 26
Serial peripheral interface. . . . . . . . . . . . . . . . 26
Register description . . . . . . . . . . . . . . . . . . . . 26
11.6.2
11.6.3
12
13
14
14.1
14.2
14.3
14.4
15
16
Default modes at start-up. . . . . . . . . . . . . . . . 27
Register allocation map . . . . . . . . . . . . . . . . . 29
Package outline. . . . . . . . . . . . . . . . . . . . . . . . 35
Revision history . . . . . . . . . . . . . . . . . . . . . . . 36
Legal information . . . . . . . . . . . . . . . . . . . . . . 37
Data sheet status. . . . . . . . . . . . . . . . . . . . . . 37
Definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Disclaimers . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Trademarks . . . . . . . . . . . . . . . . . . . . . . . . . . 38
Contact information . . . . . . . . . . . . . . . . . . . . 38
Contents. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39