AVDD = DV
參數(shù)資料
型號(hào): ADF4107BRUZ
廠(chǎng)商: Analog Devices Inc
文件頁(yè)數(shù): 14/20頁(yè)
文件大?。?/td> 0K
描述: IC PLL FREQ SYNTHESIZER 16TSSOP
標(biāo)準(zhǔn)包裝: 96
類(lèi)型: 時(shí)鐘/頻率合成器,RF
PLL:
輸入: CMOS,TTL
輸出: 時(shí)鐘
電路數(shù): 1
比率 - 輸入:輸出: 2:1
差分 - 輸入:輸出: 是/無(wú)
頻率 - 最大: 7GHz
除法器/乘法器: 無(wú)/無(wú)
電源電壓: 2.7 V ~ 3.3 V
工作溫度: -40°C ~ 85°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 16-TSSOP
包裝: 管件
產(chǎn)品目錄頁(yè)面: 551 (CN2011-ZH PDF)
Data Sheet
ADF4107
Rev. D | Page 3 of 20
SPECIFICATIONS
AVDD = DVDD = 3 V ± 10%, AVDD ≤ VP ≤ 5.5 V, AGND = DGND = CPGND = 0 V, RSET = 5.1 k, dBm referred to 50 , TA = TMAX to TMIN,
unless otherwise noted.
Table 1.
Parameter
BVersion1
B Chips2 (Typ)
Unit
Test Conditions/Comments
RF CHARACTERISTICS
RF Input Frequency (RFIN)3
1.0/7.0
GHz min/max
See Figure 18 for input circuit
RF Input Sensitivity
–5/+5
dBm min/max
Maximum Allowable Prescaler Output
Frequency4
300
MHz max
REFIN CHARACTERISTICS
REFIN Input Frequency
20/250
MHz min/max
For f < 20 MHz, ensure slew rate >50 V/s
REFIN Input Sensitivity5
0.8/VDD
V p-p min/max
Biased at AVDD/26
REFIN Input Capacitance
10
pF max
REFIN Input Current
±100
A max
PHASE DETECTOR
Phase Detector Frequency7
104
MHz max
ABP = 0,0 (2.9 ns antibacklash pulse width)
CHARGE PUMP
Programmable; see Figure 25
ICP Sink/Source
High Value
5
mA typ
With RSET = 5.1 k
Low Value
625
A typ
Absolute Accuracy
2.5
% typ
With RSET = 5.1 k
RSET Range
3.0 to 11
k typ
ICP Three-State Leakage
1
nA typ
Sink and Source Current Matching
2
% typ
0.5 V ≤ VCP ≤ VP 0.5 V
ICP vs. VCP
1.5
% typ
0.5 V ≤ VCP ≤ VP 0.5 V
ICP vs. Temperature
2
% typ
VCP = VP/2
LOGIC INPUTS
VIH, Input High Voltage
1.4
V min
VIL, Input Low Voltage
0.6
V max
IINH, IINL, Input Current
±1
A max
CIN, Input Capacitance
10
pF max
LOGIC OUTPUTS
VOH, Output High Voltage
1.4
V min
Open-drain output chosen; 1 k pull-up
resistor to 1.8 V
VOH, Output High Voltage
VDD 0.4
V min
CMOS output chosen
IOH
100
A max
VOL, Output Low Voltage
0.4
V max
IOL = 500 A
POWER SUPPLIES
AVDD
2.7/3.3
V min/V max
DVDD
AVDD
VP
AVDD/5.5
V min/V max
AVDD ≤ VP ≤ 5.5 V
IDD8 (AIDD + DIDD)
17
15
mA max
15 mA typ
IP
0.4
mA max
TA = 25°C
Power-Down Mode9 (AIDD + DIDD)
10
A typ
NOISE CHARACTERISTICS
Normalized Phase Noise Floor (PNSYNTH)10
223
dBc/Hz typ
PLL loop BW = 500 kHz, measured at
100 kHz offset
Normalized 1/f Noise (PN1_f)11
122
dBc/Hz typ
10 kHz offset; normalized to 1 GHz
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ADF4108 制造商:AD 制造商全稱(chēng):Analog Devices 功能描述:PLL Frequency Synthesizer