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參數(shù)資料
| 型號： | ADG3123BRUZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 10/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC XLATOR 8CH LOG-HV 20-TSSOP |
| 標準包裝： | 75 |
| 邏輯功能： | 變換器 |
| 位數(shù)： | 8 |
| 輸入類型： | CMOS |
| 輸出類型： | 電壓 |
| 通道數(shù)： | 8 |
| 輸出/通道數(shù)目： | 1 |
| 差分 - 輸入:輸出： | 無/無 |
| 傳輸延遲（最大）： | 125ns |
| 電源電壓： | 2.3 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 20-TSSOP |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 802 (CN2011-ZH PDF) |
Data Sheet
ADG3123
Rev. B | Page 7 of 12
300
0
0.10
CAPACITIVE LOAD (nF)
R
ISE
T
IME
(n
s
)
250
200
150
100
50
0.60
1.10
1.60
2.10
2.60
3.10
3.60
4.10
TA = 25°C
VDDA = VDDB = 27V
VSS = –7V
RL = 5k
FREQUENCY = 20kHz
DUTY CYCLE = 50%
1 CHANNEL
05655-
010
Figure 10. Rise Time vs. Capacitive Load
500
300
350
400
450
0
0.10
CAPACITIVE LOAD (nF)
F
AL
L
T
IME
(n
s
)
250
200
150
100
50
0.60
1.10
1.60
2.10
2.60
3.10
3.60
4.10
TA = 25°C
VDDA = VDDB = 27V
VSS = –7V
RL = 5k
FREQUENCY = 20kHz
DUTY CYCLE = 50%
1 CHANNEL
05655-
0
1
Figure 11. Fall Time vs. Capacitive Load
140
160
180
60
0.10
CAPACITIVE LOAD (nF)
t PL
H
(
n
s)
120
100
80
0.60
1.10
1.60
2.10
2.60
3.10
3.60
4.10
TA = 25°C
VDDA = VDDB = 27V
VSS = –7V
RL = 5k
FREQUENCY = 20kHz
DUTY CYCLE = 50%
1 CHANNEL
05655-
012
Figure 12. Propagation Delay (tPLH) vs. Capacitive Load
220
270
70
0.10
CAPACITIVE LOAD (nF)
t PL
H
(
n
s)
170
120
0.60
1.10
1.60
2.10
2.60
3.10
3.60
4.10
TA = 25°C
VDDA = VDDB = 27V
VSS = –7V
RL = 5k
FREQUENCY = 20kHz
DUTY CYCLE = 50%
1 CHANNEL
05655-
013
Figure 13. Propagation Delay (tPHL) vs. Capacitive Load
10
1
0.1
0.01
0.1
1
10
05655-
014
F
R
EQ
U
EN
C
Y
(MH
z)
CAPACITIVE LOAD (nF)
VDDA = VDDB = 27V
VSS = –7V
TA = 250°C
1 CHANNEL
Figure 14. Maximum Operating Frequency vs. Capacitive Load
(One Channel)
1000
10
100
1
0.01
0.1
1
10
05655-
015
F
RE
Q
UE
NCY
(
kHz
)
CAPACITIVE LOAD (nF)
VDDA = VDDB = 27V
VSS = –7V
TA = 25°C
8 CHANNELS
Figure 15. Maximum Operating Frequency vs. Capacitive Load
(Eight Channels)
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PDF描述 |
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