ADG714 TIMING CHARACTERISTICS1, 2 Parameter Limit at T
參數(shù)資料
型號: ADG715BRU-REEL7
廠商: Analog Devices Inc
文件頁數(shù): 12/16頁
文件大?。?/td> 0K
描述: IC SWITCH OCTAL SPST 24TSSOP
產(chǎn)品培訓模塊: Switch Fundamentals
標準包裝: 1,000
功能: 開關(guān)
電路: 8 x SPST - NO
導(dǎo)通狀態(tài)電阻: 4.5 歐姆
電壓電源: 單/雙電源
電壓 - 電源,單路/雙路(±): 2.7 V ~ 5.5 V,±2.5V
電流 - 電源: 10µA
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 24-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 24-TSSOP
包裝: 帶卷 (TR)
ADG714/ADG715
–5–
REV.
ADG714 TIMING CHARACTERISTICS1, 2
Parameter
Limit at TMIN, TMAX
Unit
Conditions/Comments
fSCLK
30
MHz max
SCLK Cycle Frequency
t1
33
ns min
SCLK Cycle Time
t2
13
ns min
SCLK High Time
t3
13
ns min
SCLK Low Time
t4
0
ns min
SYNC to SCLK Rising Edge Setup Time
t5
5
ns min
Data Setup Time
t6
4.5
ns min
Data Hold Time
t7
0
ns min
SCLK Falling Edge to
SYNC Rising Edge
t8
33
ns min
Minimum
SYNC High Time
t9
3
20
ns max
SCLK Rising Edge to DOUT Valid
NOTES
1See Figure 1.
2All input signals are specied with tr = tf = 5 ns (10% to 90% of V
DD) and timed from a voltage level of (V IL + VIH)/2.
3C
L = 20 pF, RL = 1 k
Ω.
Specications subject to change without notice.
SCLK
SYNC
DIN
DOUT
t8
t4
t6
t5
t2
t3
t1
t7
t9
DB0
DB7
DB7*
DB6*
DB2*
DB1*
DB0*
*DATA FROM PREVIOUS WRITE CYCLE
Figure 1. 3-Wire Serial Interface Timing Diagram
(VDD = 2.7 V to 5.5 V. All specications –40 C to +85 C unless otherwise noted.)
C
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