參數(shù)資料
型號： ADL5304ACPZ-R7
廠商： Analog Devices Inc
文件頁數(shù)： 27/32頁
文件大小： 0K
描述： IC AMP LOG CONV 32LFCSP
標(biāo)準(zhǔn)包裝： 1
類型： 對數(shù)轉(zhuǎn)換器
應(yīng)用： 光纖
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 32-LFCSP-VQ（5x5）
包裝： 標(biāo)準(zhǔn)包裝
其它名稱： ADL5304ACPZ-R7DKR
ADL5304
Data Sheet
Rev. 0 | Page 4 of 32
Parameter
Test Conditions/Comments
Min
Typ
Max
Unit
POWER SUPPLY
VPOS, VNEG
VPOS
4.5
5.0
5.5
V
Quiescent Current
INUM = IDEN = 10 μA; VPOS = 5 V, VNEG = 0 V
13.5
16
mA
4.5 V ≤ VPOS ≤ 5.5 V
10
17
mA
VNEG6
Nominal 0 V for single supply
0
5
V
Quiescent Current
INUM = IDEN = 10 μA; VPOS = 5 V, VNEG = 0 V
8.5
7.3
mA
VNEG = 5 V
10.5
6
mA
1 Slope is of the same magnitude but opposite sign for input applied to IDEN.
2 IZ = IREF/10(VOFS/VY). Note that the error of IZ is dependent on three parameters, IREF, VOFS, and VY. All three of those are trimmed.
4 High-to-low currents (falling edge) represent the worst-case settling condition. Low-to-high currents (rising edge) settling times are ~2× faster than the falling edge
settling. Settling time is measured to 1 dB error (10 mV/dB; VLOG settles to within 10 mV of the final value).
5 IREF applied to IDEN together with 1P5V determines the logarithmic intercept current, IZ, and thereby the accuracy of the intercept.
6 Using dual-supply operation with the VSMx, DCBI, and INPS pins at ground, VNEG needs to be in the 2 V to 5 V range for proper device function.
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PDF描述
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參數(shù)描述
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