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參數(shù)資料
| 型號： | ADN2806ACPZ-500RL7 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 15/20頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK/DATA REC 622MBPS 32-LFCSP |
| 標(biāo)準(zhǔn)包裝： | 500 |
| 類型： | 時鐘和數(shù)據(jù)恢復(fù)（CDR），多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | SONET/SDH |
| 輸入： | CML |
| 輸出： | LVDS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 622MHz |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 32-LFCSP-VQ（5x5） |
| 包裝： | 帶卷 (TR) |
ADN2806
Rev. C | Page 4 of 20
OUTPUT AND TIMING SPECIFICATIONS
Table 3.
Parameter
Conditions
Min
Typ
Max
Unit
LVDS OUTPUT CHARACTERISTICS
(CLKOUTP/CLKOUTN, DATAOUTP/DATAOUTN)
Output Voltage High
1475
mV
Output Voltage Low
925
mV
Differential Output Swing
250
320
400
mV
Output Offset Voltage
1125
1200
1275
mV
Output Impedance
Differential
100
Ω
LVDS Outputs’Timing
Rise Time
20% to 80%
115
220
ps
Fall Time
80% to 20%
115
220
ps
Setup Time
760
800
840
ps
Hold Time
760
800
840
ps
I2C INTERFACE DC CHARACTERISTICS
LVCMOS
Input High Voltage
VIH
0.7 VCC
V
Input Low Voltage
VIL
0.3 VCC
V
Input Current
VIN = 0.1 VCC or VIN = 0.9 VCC
10.0
+10.0
μA
Output Low Voltage
VOL, IOL = 3.0 mA
0.4
V
I2C INTERFACE TIMING
See Figure 10
SCK Clock Frequency
400
kHz
SCK Pulse Width High
tHIGH
600
ns
SCK Pulse Width Low
tLOW
1300
ns
Start Condition Hold Time
tHD;STA
600
ns
Start Condition Setup Time
tSU;STA
600
ns
Data Setup Time
tSU;DAT
100
ns
Data Hold Time
tHD;DAT
300
ns
SCK/SDA Rise/Fall Time
TR/TF
300
ns
Stop Condition Setup Time
tSU;STO
600
ns
Bus Free Time Between a Stop and a Start
tBUF
1300
ns
REFCLK CHARACTERISTICS
Optional lock to REFCLK mode
Input Voltage Range
@ REFCLKP or REFCLKN
VIL
0
V
VIH
VCC
V
Minimum Differential Input Drive
100
mV p-p
Reference Frequency
10
160
MHz
Required Accuracy
100
ppm
LVTTL DC INPUT CHARACTERISTICS
Input High Voltage
VIH
2.0
V
Input Low Voltage
VIL
0.8
V
Input High Current
IIH, VIN = 2.4 V
5
μA
Input Low Current
IIL, VIN = 0.4 V
5
μA
LVTTL DC OUTPUT CHARACTERISTICS
Output High Voltage
VOH, IOH = 2.0 mA
2.4
V
Output Low Voltage
VOL, IOL = +2.0 mA
0.4
V
1 Cb = total capacitance of one bus line in picofarads. If used with Hs-mode devices, faster fall times are allowed.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CS3101A-32-22S | CONN RCPT 54POS IN LINE W/SCKT |
| VE-JTX-MX-F3 | CONVERTER MOD DC/DC 5.2V 75W |
| VE-JTX-MX-F2 | CONVERTER MOD DC/DC 5.2V 75W |
| VE-JTW-MX-F4 | CONVERTER MOD DC/DC 5.5V 75W |
| ADN2804ACPZ-RL7 | IC CLK/DATA REC 622MBPS 32-LFCSP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ADN2806ACPZ-RL7 | 功能描述:IC CLK/DATA REC 622MBPS 32-LFCSP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:- 標(biāo)準(zhǔn)包裝:28 系列:- 類型:時鐘/頻率發(fā)生器 PLL:是 主要目的:Intel CPU 服務(wù)器 輸入:時鐘 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:3:22 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:64-TFSOP （0.240"，6.10mm 寬） 供應(yīng)商設(shè)備封裝:64-TSSOP 包裝:管件 |
| ADN2807 | 制造商:AD 制造商全稱:Analog Devices 功能描述:155/622 Mb/s Clock and Data Recovery IC with Integrated Limiting Amp |
| ADN2807ACP | 制造商:Analog Devices 功能描述:CDR 155.52Mbps/166.63Mbps/622.08Mbps/666.51Mbps SONET/SDH 48-Pin LFCSP EP Tray |
| ADN2807ACP-RL | 制造商:AD 制造商全稱:Analog Devices 功能描述:155/622 Mb/s Clock and Data Recovery IC with Integrated Limiting Amp |
| ADN2807ACPZ | 功能描述:IC CLOCK/DATA RECOVERY 48LFCSP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:- 標(biāo)準(zhǔn)包裝:28 系列:- 類型:時鐘/頻率發(fā)生器 PLL:是 主要目的:Intel CPU 服務(wù)器 輸入:時鐘 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:3:22 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:64-TFSOP （0.240"，6.10mm 寬） 供應(yīng)商設(shè)備封裝:64-TSSOP 包裝:管件 |
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