參數(shù)資料
型號(hào)： ADN2806ACPZ-RL7
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 18/20頁(yè)
文件大小： 0K
描述： IC CLK/DATA REC 622MBPS 32-LFCSP
標(biāo)準(zhǔn)包裝： 1,500
類型： 時(shí)鐘和數(shù)據(jù)恢復(fù)（CDR），多路復(fù)用器
PLL： 是
主要目的： SONET/SDH
輸入： CML
輸出： LVDS
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 622MHz
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 32-LFCSP-VQ（5x5）
包裝： 帶卷 (TR)
ADN2806
Rev. C | Page 7 of 20
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
0
5831-
00
4
NOTES
1. NC = NO CONNECT.
2. THERE IS AN EXPOSED PAD ON THE BOTTOM OF THE
PACKAGE THAT MUST BE CONNECTED TO GND.
1
TEST1
2
3
VCC
VREF
TOP VIEW
(Not to Scale)
24 VCC
23 VEE
22 NC
21 SDA
32
T
EST
2
20 SCK
19 SADDR5
18 VCC
17 VEE
N
C
9
R
E
FC
LK
P
1
0
RE
F
C
L
KN
11
VCC
1
2
VEE
1
3
CF
21
4
CF
11
5
LOL
1
6
NIN 4
PIN 5
NC 6
NC 7
VEE 8
31
V
C
30
VEE
29
D
A
TA
O
U
TP
28
D
A
TA
O
U
TN
27
S
Q
U
E
L
C
H
26
CL
K
O
UT
P
25
CL
K
O
UT
N
ADN2806
PIN 1
INDICATOR
Figure 5. Pin Configuration
Table 5. Pin Function Descriptions
Pin No.
Mnemonic
Type1
Description
1
TEST1
AI
Connect to VCC.
2
VCC
P
Power for Limiting Amplifier, LOS.
3
VREF
AO
Internal VREF Voltage. Decouple to GND with a 0.1 μF capacitor.
4
NIN
AI
Differential Data Input. CML.
5
PIN
AI
Differential Data Input. CML.
6
NC
No Connect.
7
NC
No Connect.
8
VEE
P
GND for Limiting Amplifier, LOS.
9
NC
No Connect.
10
REFCLKP
DI
Differential REFCLK Input. 10 MHz to 160 MHz.
11
REFCLKN
DI
Differential REFCLK Input. 10 MHz to 160 MHz.
12
VCC
P
VCO Power.
13
VEE
P
VCO GND.
14
CF2
AO
Frequency Loop Capacitor.
15
CF1
AO
Frequency Loop Capacitor.
16
LOL
DO
Loss-of-Lock Indicator. LVTTL active high.
17
VEE
P
FLL Detector GND.
18
VCC
P
FLL Detector Power.
19
SADDR5
DI
Slave Address Bit 5.
20
SCK
DI
I2C Clock Input.
21
SDA
DI
I2C Data Input.
22
NC
No Connect.
23
VEE
P
Output Buffer, I2C GND.
24
VCC
P
Output Buffer, I2C Power.
25
CLKOUTN
DO
Differential Recovered Clock Output. LVDS.
26
CLKOUTP
DO
Differential Recovered Clock Output. LVDS.
27
SQUELCH
DI
Disable Clock and Data Outputs. Active high. LVTTL.
28
DATAOUTN
DO
Differential Recovered Data Output. LVDS.
29
DATAOUTP
DO
Differential Recovered Data Output. LVDS.
30
VEE
P
Phase Detector, Phase Shifter GND.
31
VCC
P
Phase Detector, Phase Shifter Power.
32
TEST2
AI
Connect to VCC.
Exposed Pad
Pad
P
Connect to GND. Works as a heat sink.
1 Type: P = power, AI = analog input, AO = analog output, DI = digital input, DO = digital output.
相關(guān)PDF資料
PDF描述
MS3120F20-39SW CONN RCPT 39POS WALL MNT W/SCKT
VE-JTV-MX-F4 CONVERTER MOD DC/DC 5.8V 75W
XRT8001IDTR-F IC WAN CLOCK E1/E1 DUAL 18SOIC
VE-JTV-MX-F3 CONVERTER MOD DC/DC 5.8V 75W
VE-JTV-MX-F1 CONVERTER MOD DC/DC 5.8V 75W
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
ADN2807 制造商:AD 制造商全稱:Analog Devices 功能描述:155/622 Mb/s Clock and Data Recovery IC with Integrated Limiting Amp
ADN2807ACP 制造商:Analog Devices 功能描述:CDR 155.52Mbps/166.63Mbps/622.08Mbps/666.51Mbps SONET/SDH 48-Pin LFCSP EP Tray
ADN2807ACP-RL 制造商:AD 制造商全稱:Analog Devices 功能描述:155/622 Mb/s Clock and Data Recovery IC with Integrated Limiting Amp
ADN2807ACPZ 功能描述:IC CLOCK/DATA RECOVERY 48LFCSP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專用 系列:- 標(biāo)準(zhǔn)包裝:28 系列:- 類型:時(shí)鐘/頻率發(fā)生器 PLL:是 主要目的:Intel CPU 服務(wù)器 輸入:時(shí)鐘 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:3:22 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:64-TFSOP （0.240"，6.10mm 寬） 供應(yīng)商設(shè)備封裝:64-TSSOP 包裝:管件
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