參數(shù)資料
型號： ADS1222IPWRG4
廠商： Texas Instruments
文件頁數(shù)： 6/26頁
文件大小： 0K
描述： IC 24BIT ADC W/2CH MUX 14-TSSOP
產(chǎn)品培訓模塊： Data Converter Basics
視頻文件： Nuts and Bolts of the Delta-Sigma Converter
標準包裝： 2,000
位數(shù)： 24
采樣率（每秒）： 240
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 1
功率耗散（最大）： 2.25mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 14-TSSOP（0.173"，4.40mm 寬）
供應商設備封裝： 14-TSSOP
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 4 個單端，單極；2 個差分，雙極
ADS1222
SBAS314B APRIL 2004 REVISED JANUARY 2009
www.ti.com
14
SYMBOL
DESCRIPTION
MIN
MAX
UNITS
t2
DRDY/DOUT low to first SCLK rising edge
0
ns
t3
SCLK positive or negative pulse width
100
ns
t4
SCLK rising edge to new data bit valid: propagation delay
50
ns
t5
SCLK rising edge to old data bit valid: hold time
0
ns
t6(1)
Data updating; no readback allowed
48
s
t7(1)
Conversion time (1/data rate)
8.32
ms
(1) Values given for fCLK = 2MHz. For different fCLK frequencies, scale proportional to CLK period.
DRDY/DOUT
23
22
21
124
0
LSB
MSB
Data
Data Ready
SCLK
t
2
t
7
t
3
t
3
t
6
New Data Ready
t
4
t
5
Figure 25. Data Retrieval Timing
23
124
25
22
21
0
Data
25th SCLK to Force DRDY/DOUT High
Data Ready
New Data Ready
DRDY/DOUT
SCLK
Figure 26. Data Retrieval with DRDY/DOUT Forced High Afterwards
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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