參數(shù)資料
型號: ADSP-21060CW-160
廠商: Analog Devices Inc
文件頁數(shù): 36/64頁
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描述: IC DSP CONTROLLER 32BIT 240CQFP
產品培訓模塊: SHARC Processor Overview
標準包裝: 1
系列: SHARC®
類型: 浮點
接口: 主機接口,連接端口,串行端口
時鐘速率: 40MHz
非易失內存: 外部
芯片上RAM: 512kB
電壓 - 輸入/輸出: 5.00V
電壓 - 核心: 5.00V
工作溫度: -40°C ~ 100°C
安裝類型: 表面貼裝
封裝/外殼: 240-CBFQFP 裸露焊盤
供應商設備封裝: 240-CQFP(32x32)
包裝: 托盤
ADSP-21060/ADSP-21060L/ADSP-21062/ADSP-21062L/ADSP-21060C/ADSP-21060LC
Rev. F
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March 2008
Figure 24. Link Ports—Receive
CLKIN
LCLK
LDAT(3:0)
LACK
LCLK 1x
OR
LCLK 2x
CLKIN
LDAT(3:0)
LACK (IN)
LCLK 1x
OR
LCLK 2x
LDAT(3:0)
LACK (OUT)
THE
t
SLACH REQUIREMENT APPLIES TO THE RISING EDG E O F LCLK ONLY FO R THE FIRST NIBBLE TRANSMITTED.
CLKIN
TRANSMIT
tDLDCH
tHLDCH
tDLCLK
tLCLKTWH
tLCLKTWL
tSLACH
tHLACH
tDLACLK
tSLDCL
tHLDCL
tLCLKRWH
tDLAHC
tDLALC
LINK PORT ENABLE OR THREE-STATE TAKES EFFECT 2 CYCLES AFTER A WRITE TO A LINK PORT CONTROL REGISTER.
tENDLK
tTDLK
RECEIVE
LINK PORT ENABLE/THREE-STATE DELAY FROM INSTRUCTION
tLCLKRWL
tLCLKIW
CLKIN
tSLCK
tHLCK
LINK PORT INTERRUPT SETUP TIME
LCLK
LAST NIBBLE
TRANSMITTED
FIRST NIBBLE
TRANSMITTED
LCLK INACTIVE
(HIGH)
OUT
IN
LACK
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PDF描述
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