Timing Requirements: tSCK
參數(shù)資料
型號(hào)： ADSP-2186MKSTZ300R
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 21/40頁(yè)
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 100LQFP
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類(lèi)型： 定點(diǎn)
接口： 主機(jī)接口，串行端口
時(shí)鐘速率： 75MHz
非易失內(nèi)存： 外部
芯片上RAM： 40kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 2.50V
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 標(biāo)準(zhǔn)包裝
其它名稱(chēng)： ADSP-2186MKSTZ300RDKR
REV. 0
–28–
ADSP-2186M
Serial Ports
Parameter
Min
Max
Unit
Serial Ports
Timing Requirements:
tSCK
SCLK Period
26.6
ns
tSCS
DR/TFS/RFS Setup before SCLK Low
4
ns
tSCH
DR/TFS/RFS Hold after SCLK Low
7
ns
tSCP
SCLKIN Width
12
ns
Switching Characteristics:
tCC
CLKOUT High to SCLKOUT
0.25tCK
0.25tCK + 6
ns
tSCDE
SCLK High to DT Enable
0
ns
tSCDV
SCLK High to DT Valid
12
ns
tRH
TFS/RFSOUT Hold after SCLK High
0
ns
tRD
TFS/RFSOUT Delay from SCLK High
12
ns
tSCDH
DT Hold after SCLK High
0
ns
tTDE
TFS (Alt) to DT Enable
0
ns
tTDV
TFS (Alt) to DT Valid
12
ns
tSCDD
SCLK High to DT Disable
12
ns
tRDV
RFS (Multichannel, Frame Delay Zero) to DT Valid
12
ns
CLKOUT
SCLK
TFSOUT
RFSOUT
DT
ALTERNATE
FRAME MODE
tCC
tSCS
tSCH
tRH
tSCDE
tSCDH
tSCDD
tTDE
tRDV
MULTICHANNEL
MODE,
FRAME DELAY 0
(MFD = 0)
DR
TFSIN
RFSIN
RFSOUT
TFSOUT
tTDV
tSCDV
tRD
tSCP
tSCK
tSCP
TFSIN
RFSIN
ALTERNATE
FRAME MODE
tRDV
MULTICHANNEL
MODE,
FRAME DELAY 0
(MFD = 0)
tTDV
tTDE
Figure 26. Serial Ports
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PDF描述
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