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參數(shù)資料
| 型號： | ADSP-BF512KSWZ-3 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 21/68頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP 16/32B 300MHZ LP 176LQFP |
| 標準包裝： | 40 |
| 系列： | Blackfin® |
| 類型： | 定點 |
| 接口： | I²C，PPI，SPI，SPORT，UART/USART |
| 時鐘速率： | 300MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 116kB |
| 電壓 - 輸入/輸出： | 1.8V，2.5V，3.3V |
| 電壓 - 核心： | 1.30V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 176-LQFP 裸露焊盤 |
| 供應商設(shè)備封裝： | 176-LQFP-EP（24x24） |
| 包裝： | 托盤 |
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Rev. B
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January 2011
ADSP-BF512/BF512F, BF514/BF514F, BF516/BF516F, BF518/BF518F
Flash Reset Timing
Driving the RESET pin low resets the Flash device. Driving the
RESET pin high puts the device in normal operating mode. The
SO pin is in high impedance state while the device is in reset. A
successful reset will reset the status register to its power-up state.
See Table 25 for default power-up modes. A device reset during
an active Program or Erase operation aborts the operation and
data of the targeted address range may be corrupted or lost due
to the aborted erase or program operation. The device exits AAI
Programming Mode in progress and places the SO pin in high
impedance state.
Figure 8. Power-Up Reset Timing
RESET
tRST_IN_PWR
CLKIN
V
DD_SUPPLIES
Table 25. RESET Timing
Parameter
Min
Max
Unit
Timing Requirements
tRECR
Reset Recovery from Read
100
ns
tRECP
Reset Recovery from Program
10
μs
fRECE
Reset Recovery from Erase
1ms
Figure 9. Flash Reset Timing
SCK
RST
tRECR
tRECP
tRECE
CE
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PDF描述 |
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