參數(shù)資料
型號： ADSP-BF542BBCZ-5A
廠商： Analog Devices Inc
文件頁數(shù)： 47/100頁
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描述： IC DSP 16BIT 533MHZ 400CSBGA
產(chǎn)品培訓(xùn)模塊： Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
標(biāo)準(zhǔn)包裝： 1
系列： Blackfin®
類型： 定點(diǎn)
接口： CAN，SPI，SSP，TWI，UART，USB
時(shí)鐘速率： 533MHz
非易失內(nèi)存： 外部
芯片上RAM： 132kB
電壓 - 輸入/輸出： 2.50V，3.30V
電壓 - 核心： 1.25V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 400-LFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 400-CSPBGA（17x17）
包裝： 托盤
配用： ADZS-BF548-EZLITE-ND - KIT EZLITE ADZS-BF548
Rev. C
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February 2010
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
DDR SDRAM/Mobile DDR SDRAM Write Cycle Timing
Table 34 and Figure 20 describe DDR SDRAM/mobile DDR
SDRAM write cycle timing.
Table 34. DDR SDRAM/Mobile DDR SDRAM Write Cycle Timing
DDR SDRAM
Mobile DDR SDRAM
Parameter
Min
Max
Min
Max
Unit
Switching Characteristics
tDQSS
Write CMD to First DQS0-1
0.75
1.25
0.75
1.25
tCK
tDS
DQ0-15/DQM0-1 Setup to DQS0-1
0.90
ns
tDH
DQ0-15/DQM0-1 Hold to DQS0-1
0.90
ns
tDSS
DQS0-1 Falling to DCK0-1 Rising (DQS0-1 Setup)
0.20
tCK
tDSH
DQS0-1 Falling from DCK0-1 Rising (DQS0-1 Hold)
0.20
tCK
tDQSH
DQS0-1 High Pulse Width
0.35
0.40
0.60
tCK
tDQSL
DQS0-1 Low Pulse Width
0.35
0.40
0.60
tCK
tWPRE
DQS0-1 Write Preamble
0.25
tCK
tWPST
DQS0-1 Write Postamble
0.40
0.60
0.40
0.60
tCK
tDOPW
DQ0-15 and DQM0-1 Output Pulse Width (for Each)
1.75
ns
Figure 20. DDR SDRAM /Mobile DDR SDRAM Controller Write Cycle Timing
DCK0-1
DQS0-1
DQ0-15/DQM0-1
tDQSS
tDSH
tDSS
tDQSL
tDQSH
tWPST
tWPRE
tDS
tDH
tDOPW
CONTROL
Write CMD
Dn
Dn+1
Dn+2
Dn+3
NOTE: CONTROL =
DCS0-1, DCLKE, DRAS, DCAS, AND DWE.
相關(guān)PDF資料
PDF描述
RW2-1215D/SMD CONV DC/DC 2W 9-18VIN +/-15VOUT
ECC06DCMI CONN EDGECARD 12POS .100 WW
DS1780E+ IC CPU PERIPHERAL MON 24-TSSOP
VE-B1V-CX-B1 CONVERTER MOD DC/DC 5.8V 75W
TMK316BJ335KL-T CAP CER 3.3UF 25V 10% X5R 1206
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