參數(shù)資料
型號： ADSP-TS201SABP-060
廠商： Analog Devices Inc
文件頁數(shù)： 39/48頁
文件大?。?/td> 0K
描述： IC PROCESSOR 600MHZ 576BGA
標準包裝： 1
系列： TigerSHARC®
類型： 定點/浮點
接口： 主機接口，連接端口，多處理器
時鐘速率： 600MHz
非易失內(nèi)存： 外部
芯片上RAM： 3MB
電壓 - 輸入/輸出： 2.50V
電壓 - 核心： 1.20V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 576-BBGA 裸露焊盤
供應(yīng)商設(shè)備封裝： 576-BGA-ED（25x25）
包裝： 托盤
配用： ADZS-TS201S-EZLITE-ND - KIT LITE EVAL FOR ADSP-TS201S
Rev. C
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December 2006
ADSP-TS201S
U1
MSSD0
V1
MSSD2
W1
CONTROLIMP0
Y1
EMU
U2
RST_OUT
V2
DS2
W2
ENEDREG
Y2
TCK
U3
ID2
V3
POR_IN
W3
TDI
Y3
TMR0E
U4
DS1
V4
CONTROLIMP1
W4
TDO
Y4
FLAG3
U5
VDD_IO
V5
VSS
W5
VDD_IO
Y5
VSS
U6
VDD
V6
VDD
W6
VDD
Y6
VDD_IO
U7
VDD
V7
VDD
W7
VDD
Y7
VSS
U8
VSS
V8
VDD
W8
VDD
Y8
VDD_IO
U9
VSS
V9
VDD
W9
VDD
Y9
VSS
U10
VDD
V10
VDD
W10
VDD
Y10
VDD_IO
U11
VDD_DRAM
V11
VDD_DRAM
W11
VDD_DRAM
Y11
VDD_IO
U12
VSS
V12
VDD_DRAM
W12
VDD_DRAM
Y12
VDD_IO
U13
VSS
V13
VDD
W13
VDD
Y13
VDD_IO
U14
VSS
V14
VDD
W14
VDD
Y14
VDD_IO
U15
VSS
V15
VDD_DRAM
W15
VDD_DRAM
Y15
VDD_IO
U16
VSS
V16
VDD_DRAM
W16
VDD_DRAM
Y16
VSS
U17
VSS
V17
VDD
W17
VDD
Y17
VDD_IO
U18
VDD
V18
VDD
W18
VDD
Y18
VSS
U19
VDD
V19
VDD
W19
VDD
Y19
VDD_IO
U20
VDD_IO
V20
VDD_IO
W20
VDD_IO
Y20
VSS
U21
L1CLKINN
V21
L1DATI3_N
W21
L1CLKON
Y21
L1DATO1_N
U22
L1CLKINP
V22
L1DATI3_P
W22
L1CLKOP
Y22
L1DATO1_P
U23
L1DATI1_N
V23
L1DATI2_N
W23
L1DATO3_N
Y23
L1DATO2_N
U24
L1DATI1_P
V24
L1DATI2_P
W24
L1DATO3_P
Y24
L1DATO2_P
AA1
FLAG2
AB1
VSS
AC1
FLAG0
AD1
VSS
AA2
FLAG1
AB2
VSS
AC2
VSS
AD2
ID1
AA3
IRQ3
AB3
VSS
AC3
VDD_IO
AD3
VDD_IO
AA4
VSS
AB4
NC
AC4
TMS
AD4
TRST
AA5
IRQ0
AB5
IRQ2
AC5
IOWR
AD5
IORD
AA6
IOEN
AB6
IRQ1
AC6
DMAR2
AD6
DMAR3
AA7
DMAR0
AB7
DMAR1
AC7
CPA
AD7
DPA
AA8
HBR
AB8
HBG
AC8
BOFF
AD8
BUSLOCK
AA9
L3BCMPO
AB9
L3ACKI
AC9
L3DATO0_N
AD9
L3DATO0_P
AA10
L3DATO1_N
AB10
L3DATO1_P
AC10
L3CLKON
AD10
L3CLKOP
AA11
L3DATO3_N
AB11
L3DATO3_P
AC11
L3DATO2_N
AD11
L3DATO2_P
AA12
VSS
AB12
VSS
AC12
L3DATI3_N
AD12
L3DATI3_P
AA13
L3DATI2_N
AB13
L3DATI2_P
AC13
L3CLKINN
AD13
L3CLKINP
AA14
L3DATI1_N
AB14
L3DATI1_P
AC14
L3DATI0_N
AD14
L3DATI0_P
AA15
NC
AB15
VSS
AC15
L3ACKO
AD15
L3BCMPI
AA16
L2DATO0_N
AB16
L2DATO0_P
AC16
L2BCMPO
AD16
L2ACKI
AA17
L2CLKON
AB17
L2CLKOP
AC17
L2DATO1_N
AD17
L2DATO1_P
AA18
L2DATO3_N
AB18
L2DATO3_P
AC18
L2DATO2_N
AD18
L2DATO2_P
AA19
L2CLKINN
AB19
L2CLKINP
AC19
L2DATI3_N
AD19
L2DATI3_P
AA20
L2DATI1_N
AB20
L2DATI1_P
AC20
L2DATI2_N
AD20
L2DATI2_P
AA21
VSS
AB21
L2ACKO
AC21
L2DATI0_N
AD21
L2DATI0_P
AA22
L1BCMPO
AB22
VSS
AC22
VDD_IO
AD22
VDD_IO
AA23
L1DATO0_N
AB23
VDD_IO
AC23
VSS
AD23
L2BCMPI
AA24
L1DATO0_P
AB24
VDD_IO
AC24
L1ACKI
AD24
VSS
1 On revision 1.x silicon, the R2 and R3 balls are NC. On revision 0.x silicon, the R2 ball is SCLK, and the R3 ball is SCLK_VREF. For more information on SCLK and SCLK_VREF
on revision 0.x silicon, see the EE-179: ADSP-TS20x TigerSHARC System Design Guidelines on the Analog Devices website (www.analog.com).
Table 35. 576-Ball (25 mm × 25 mm) BGA_ED Ball Assignments (Continued)
Ball No. Signal Name
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