參數(shù)資料
型號： AGL10002-FGG484I
元件分類： FPGA
英文描述： FPGA, 1000000 GATES, 200 MHz, PBGA484
封裝： 13 X 13 MM, 1 MM PITCH, ROHS COMPLIANT, FBGA-144
文件頁數(shù)： 152/204頁
文件大?。?/td> 2800K
代理商： AGL10002-FGG484I
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IGLOO Low-Power Flash FPGAs with Flash*Freeze Technology
A d v an c ed v0 . 1
2-37
Table 2-19 Levels of Hot-Swap Support
Hot-
Swapping
Level
Description
Power
Applied
to Device Bus State
Card
Ground
Connection
Device
Circuitry
Connected
to Bus Pins
Example of
Application with
Cards Containing
IGLOO Devices
Compliance of
IGLOO Devices
1
Cold-swap
No
–
System
and
card
with
Actel
FPGA
chip
are
powered down and the
card is plugged into the
system. Then the power
supplies are turned on for
the system but not for the
FPGA on the card.
AGL030: Compliant
Other
IGLOO
devices:
Compliant if the bus
switch is used to isolate
FPGA I/Os from the rest
of the system.
2
Hot-swap while
reset
Yes
Held in reset
state
Must be made
and
maintained
for 1 ms
before,
during, and
after
insertion/
removal
–
In
the
PCI
hot-plug
specification, reset control
circuitry isolates the card
busses
until
the
card
supplies
are
at
their
nominal operating levels
and stable.
AGL030: Compliant I/Os
can but do not have to
be set to hot insertion
mode.
Other IGLOO devices:
Compliant
3
Hot-swap while
bus idle
Yes
Held idle (no
ongoing I/O
processes
during
insertion/
removal)
Same as Level
2
Must remain
glitch-free
during
power-up or
power-down
Board bus shared with
card bus is "frozen," and
there
is
no
toggling
activity on the bus. It is
critical that the logic states
set on the bus signal are
not disturbed during card
insertion/removal.
AGL030: Compliant with
2 levels of staging (first:
GND, second: all other
pins)
Other IGLOO devices:
Compliant:
Option 1 – 2 levels of
staging
(first:
GND,
second: all other pins)
together with bus switch
on the I/Os
Option 2 – 3 levels of
staging
(first:
GND,
second: supplies, third:
all other pins)
4
Hot-swap on
an active bus
Yes
Bus may have
active I/O
processes
ongoing, but
device being
inserted or
removed
must be idle.
Same as Level
2
Same as
Level 3
There is activity on the
system
bus,
and
it
is
critical that the logic states
set on the bus signal are
not disturbed during card
insertion/removal.
AGL030: Compliant with
2 levels of staging (first:
GND, second: all other
pins)
Other IGLOO devices:
Compliant:
Option 1 – 2 levels of
staging
(first:
GND,
second: all other pins)
together with bus switch
on the I/Os
Option 2 – 3 levels of
staging
(first:
GND,
second: supplies, third:
all other pins)
相關(guān)PDF資料
PDF描述
AGL10002-FGG484 FPGA, 1000000 GATES, 200 MHz, PBGA484
AGL10005-FFG144I FPGA, 1000000 GATES, 250 MHz, PBGA144
AGL10005-FFG144 FPGA, 1000000 GATES, 250 MHz, PBGA144
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