參數(shù)資料
型號: AGL10005-FGG256I
元件分類: FPGA
英文描述: FPGA, 1000000 GATES, 250 MHz, PBGA144
封裝: 13 X 13 MM, 1 MM PITCH, ROHS COMPLIANT, FBGA-144
文件頁數(shù): 162/204頁
文件大?。?/td> 2800K
代理商: AGL10005-FGG256I
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IGLOO Low-Power Flash FPGAs with Flash*Freeze Technology
2- 46
Advanced v0.1
At the system level, the skew circuit can be used in applications where transmission activities on bidirectional data
lines need to be coordinated. This circuit, when selected, provides a timing margin that can prevent bus contention
and subsequent data loss and/or transmitter over-stress due to transmitter-to-transmitter current shorts. Figure 2-34
presents an example of the skew circuit implementation in a bidirectional communication system. Figure 2-35 shows
how bus contention is created, and Figure 2-36 on page 2-47 shows how it can be avoided with the skew circuit.
Figure 2-34 Example of Implementation of Skew Circuits in Bidirectional Transmission Systems Using IGLOO Devices
Figure 2-35 Timing Diagram (bypasses skew circuit)
Transmitter 1: IGLOO I/O
Transmitter 2: Generic I/O
ENABLE(t2)
EN (b1)
EN (b2)
Routing
Delay (t1)
Routing
Delay (t2)
EN (r1)
ENABLE (t1)
Skew or
Bypass
Skew
Bidirectional Data Bus
Transmitter
ENABLE/
DISABLE
EN (b1)
EN (b2)
ENABLE (r1)
Transmitter 1: ON
ENABLE (t2)
Transmitter 2: ON
ENABLE (t1)
Bus
Contention
Transmitter 1: OFF
Transmitter 2: OFF
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PDF描述
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