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參數(shù)資料
| 型號(hào)： | AGL400V2-CS196I |
| 廠商： | Microsemi SoC |
| 文件頁(yè)數(shù)： | 4/250頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 1KB FLASH 400K 196-CSP |
| 標(biāo)準(zhǔn)包裝： | 168 |
| 系列： | IGLOO |
| 邏輯元件/單元數(shù)： | 9216 |
| RAM 位總計(jì)： | 55296 |
| 輸入/輸出數(shù)： | 143 |
| 門(mén)數(shù)： | 400000 |
| 電源電壓： | 1.14 V ~ 1.575 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 196-TFBGA，CSBGA |
| 供應(yīng)商設(shè)備封裝： | 196-CSP（8x8） |
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IGLOO Low Power Flash FPGAs
Revision 23
2-85
Fully Registered I/O Buffers with Synchronous Enable and
Asynchronous Clear
Figure 2-17 Timing Model of the Registered I/O Buffers with Synchronous Enable and Asynchronous Clear
Enable
CLK
Pad
Out
CLK
Enable
CLR
Data_out
Data
Y
AA
EOUT
DOUT
Core
Array
DQ
DFN1E1C1
E
CLR
DQ
DFN1E1C1
E
CLR
DQ
DFN1E1C1
E
CLR
D_Enable
BB
CC
DD
EE
FF
GG
LL
HH
JJ
KK
CLKBUF
INBUF
TRIBUF
INBUF
CLKBUF
INBUF
Data Input I/O Register with
Active High Enable
Active High Clear
Positive-Edge Triggered
Data Output Register and
Enable Output Register with
Active High Enable
Active High Clear
Positive-Edge Triggered
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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