Revision 17 2-23 Detailed I/O DC Characteristics Table 2-27 Input Capacitance Symbol Definition Condition" />
參數(shù)資料
型號： AGLN020V5-QNG68
廠商： Microsemi SoC
文件頁數(shù)： 84/150頁
文件大?。?/td> 0K
描述： IC FPGA 20K 1.5V 68QFN
標準包裝： 260
系列： IGLOO nano
邏輯元件/單元數(shù)： 520
輸入/輸出數(shù)： 49
門數(shù)： 20000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -20°C ~ 70°C
封裝/外殼： 68-VFQFN 裸露焊盤
供應商設備封裝： 68-QFN（8x8）
其它名稱： 1100-1127
IGLOO nano Low Power Flash FPGAs
Revision 17
2-23
Detailed I/O DC Characteristics
Table 2-27 Input Capacitance
Symbol
Definition
Conditions
Min.
Max.
Units
CIN
Input capacitance
VIN = 0, f = 1.0 MHz
8
pF
CINCLK
Input capacitance on the clock pin
VIN = 0, f = 1.0 MHz
8
pF
Table 2-28 I/O Output Buffer Maximum Resistances 1
Standard
Drive Strength
RPULL-DOWN
(
)2
RPULL-UP
(
)3
3.3 V LVTTL / 3.3V LVCMOS
2 mA
100
300
4 mA
100
300
6 mA
50
150
8 mA
50
150
3.3 V LVCMOS Wide Range
100 A
Same as equivalent software default drive
2.5 V LVCMOS
2 mA
100
200
4 mA
100
200
6 mA
50
100
8 mA
50
100
1.8 V LVCMOS
2 mA
200
225
4 mA
100
112
1.5 V LVCMOS
2 mA
200
224
1.2 V LVCMOS 4
1 mA
315
1.2 V LVCMOS Wide Range 4
100 A
315
Notes:
1. These maximum values are provided for informational reasons only. Minimum output buffer resistance values depend
on VCCI, drive strength selection, temperature, and process. For board design considerations and detailed output buffer
resistances, use the corresponding IBIS models posted at http://www.microsemi.com/soc/download/ibis/default.aspx.
2. R(PULL-DOWN-MAX) = (VOLspec) / IOLspec
3. R(PULL-UP-MAX) = (VCCImax – VOHspec) / IOHspec
4. Applicable to IGLOO nano V2 devices operating at VCCI
VCC.
相關PDF資料
PDF描述
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參數(shù)描述
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