參數(shù)資料
型號(hào): AGLN030V2-FQNG68
元件分類: FPGA
英文描述: FPGA, PQCC68
封裝: 8 X 8 MM, 0.90 HEIGHT, 0.40 MM PITCH, ROHS COMPLIANT, QFN-68
文件頁(yè)數(shù): 109/114頁(yè)
文件大小: 3991K
代理商: AGLN030V2-FQNG68
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IGLOO nano DC and Switching Characteristics
2- 80
Advance v0.2
Timing Characteristics
1.5 V DC Core Voltage
Table 2-98 FIFO
Worst Commercial-Case Conditions: TJ = 70°C, VCC = 1.425 V
Parameter
Description
Std.
Units
tENS
REN_B, WEN_B Setup Time
1.99
ns
tENH
REN_B, WEN_B Hold Time
0.16
ns
tBKS
BLK_B Setup Time
0.30
ns
tBKH
BLK_B Hold Time
0.00
ns
tDS
Input Data (DI) Setup Time
0.76
ns
tDH
Input Data (DI) Hold Time
0.25
ns
tCKQ1
Clock HIGH to New Data Valid on DO (flow-through)
3.33
ns
tCKQ2
Clock HIGH to New Data Valid on DO (pipelined)
1.80
ns
tRCKEF
RCLK HIGH to Empty Flag Valid
3.53
ns
tWCKFF
WCLK HIGH to Full Flag Valid
3.35
ns
tCKAF
Clock HIGH to Almost Empty/Full Flag Valid
12.85
ns
tRSTFG
RESET_B LOW to Empty/Full Flag Valid
3.48
ns
tRSTAF
RESET_B LOW to Almost Empty/Full Flag Valid
12.72
ns
tRSTBQ
RESET_B LOW to Data Out LOW on DO (flow-through)
2.02
ns
RESET_B LOW to Data Out LOW on DO (pipelined)
2.02
ns
tREMRSTB
RESET_B Removal
0.61
ns
tRECRSTB
RESET_B Recovery
3.21
ns
tMPWRSTB
RESET_B Minimum Pulse Width
0.68
ns
tCYC
Clock Cycle Time
6.24
ns
FMAX
Maximum Frequency for FIFO
160
MHz
Note: For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating
values.
相關(guān)PDF資料
PDF描述
AGLN030V2-FUC81 FPGA, PBGA81
AGLN030V2-FUCG81 FPGA, PBGA81
AGLN030V2-FVQ100 FPGA, PQFP100
AGLN030V2-FVQG100 FPGA, PQFP100
AGLN030V2-ZFCS81 FPGA, PBGA81
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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AGLN030V2-ZQNG48I 功能描述:IC FPGA NANO 1KB 30K 48-QFN RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列) 系列:IGLOO nano 標(biāo)準(zhǔn)包裝:152 系列:IGLOO PLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):792 RAM 位總計(jì):- 輸入/輸出數(shù):120 門(mén)數(shù):30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA,CSBGA 供應(yīng)商設(shè)備封裝:289-CSP(14x14)
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