Revision 17 2-41 I/O Register Specifications Fully Registered I/O Buffers with Asynchronous Preset Figu" />
參數(shù)資料
型號： AGLN030V5-ZUCG81I
廠商： Microsemi SoC
文件頁數(shù)： 104/150頁
文件大小： 0K
描述： IC FPGA NANO 1KB 30K 81-UCSP
標(biāo)準包裝： 490
系列： IGLOO nano
邏輯元件/單元數(shù)： 768
輸入/輸出數(shù)： 66
門數(shù)： 30000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 81-WFBGA，CSBGA
供應(yīng)商設(shè)備封裝： 81-UCSP（4x4）
IGLOO nano Low Power Flash FPGAs
Revision 17
2-41
I/O Register Specifications
Fully Registered I/O Buffers with Asynchronous Preset
Figure 2-12 Timing Model of Registered I/O Buffers with Asynchronous Preset
INBUF
TRIBUF
CLKBUF
INBUF
CLKBUF
Data Input I/O Register with:
Active High Preset
Positive-Edge Triggered
Data Output Register and
Enable Output Register with:
Active High Preset
Postive-Edge Triggered
Pad
Out
CLK
Preset
Data_out
Data
EOUT
DOUT
CLK
DQ
DFN1P1
PRE
DQ
DFN1P1
PRE
DQ
DFN1P1
PRE
D_Enable
A
C
D
E
F
H
I
J
L
Y
Core
Array
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PDF描述
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