Revision 16 2-43 Fully Registered I/O Buffers with Asynchronous Clear Figure 2-13 Timing Model of " />
參數(shù)資料
型號： AGLP125V5-CS281
廠商： Microsemi SoC
文件頁數(shù)： 88/134頁
文件大?。?/td> 0K
描述： IC FPGA IGLOO PLUS 125K 281-CSP
標準包裝： 184
系列： IGLOO PLUS
邏輯元件/單元數(shù)： 3120
RAM 位總計： 36864
輸入/輸出數(shù)： 212
門數(shù)： 125000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 281-TFBGA，CSBGA
供應商設(shè)備封裝： 281-CSP（10x10）
IGLOO PLUS Low Power Flash FPGAs
Revision 16
2-43
Fully Registered I/O Buffers with Asynchronous Clear
Figure 2-13 Timing Model of the Registered I/O Buffers with Asynchronous Clear
CLK
Pad
Out
CLK
CLR
Data_out
Data
Y
AA
EOUT
DOUT
Core
Array
DQ
DFN1C1
CLR
DQ
DFN1C1
CLR
DQ
DFN1C1
CLR
D_Enable
CC
DD
EE
FF
LL
HH
JJ
CLKBUF
INBUF
TRIBUF
INBUF
CLKBUF
INBUF
Data Input I/O Register with
Active High Clear
Positive-Edge Triggered
Data Output Register and
Enable Output Register with
Active High Clear
Positive-Edge Triggered
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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