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參數(shù)資料
| 型號(hào)： | AK4122VQ |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 24 BIT 96KHZ SRC WITH DIR |
| 中文描述： | 24位96kHz Src與迪爾 |
| 文件頁數(shù)： | 11/54頁 |
| 文件大小： | 403K |
| 代理商： | AK4122VQ |
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ASAHI KASEI
[AK4122]
MS0267-E-03
2004/08
- 11 -
Parameter
Output for PORT3 (Slave mode)
BICK Period
BICK Pulse Width Low
Pulse Width High
LRCK Edge to BICK “
↑
” (Note 11)
BICK “
↑
” to LRCK Edge (Note 11)
LRCK to SDTO (MSB) (Except I
2
S mode)
BICK “
↓
” to SDTO
Output for PORT2 (Master mode)
BICK2 Frequency
BICK2 Duty
BICK2 “
↓
” to LRCK2
BICK2 “
↓
” to SDTIO
Output for PORT3 (Master mode)
BICK Frequency
BICK Duty
BICK “
↓
” to LRCK
BICK “
↓
” to SDTO
Control Interface Timing
CCLK Period (Note 12)
CCLK Pulse Width Low
Pulse Width High
CDTI Setup Time
CDTI Hold Time
CSN “H” Time
CSN “
↓
” to CCLK “
↑
”
CCLK “
↑
” to CSN “
↑
”
CDTO Delay
CSN “
↑
” to CDTO Hi-Z
Reset Timing
PDN Pulse Width (Note 13)
Note 11. BICK rising edge must not occur at the same time as LRCK edge.
Note 12. In case of using INT2. When INT2 is not used, the max value is not limited.
Note 13. The AK4122 can be reset by bringing the PDN pin = “L”.
Symbol
min
1/64fs
65
65
30
30
20
20
20
20
200
80
80
40
40
150
50
50
150
typ
64fs
50
64fs
50
max
30
30
20
30
20
30
1000
45
70
Units
ns
ns
ns
ns
ns
ns
ns
Hz
%
ns
ns
Hz
%
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
tBCK
tBCKL
tBCKH
tLRB
tBLR
tLRS
tBSD
fBCK
dBCK
tMBLR
tBSD
fBCK
dBCK
tMBLR
tBSD
tCCK
tCCKL
tCCKH
tCDS
tCDH
tCSW
tCSS
tCSH
tDCD
tCCZ
tPD
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| ALD2711PA | DUAL MICROPOWER PRECISION RAIL TO RAIL CMOS OPERATIONAL AMPLIFIER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AK4122VQP-L | 制造商:Asahi Kasei Microsystems Co Ltd 功能描述: |
| AK4124 | 制造商:AKM 制造商全稱:AKM 功能描述:192KHZ/ 24BIT HIGH PERFORMANCE ASYNCHRONOUS SRC |
| AK4124VF | 制造商:AKM 制造商全稱:AKM 功能描述:192KHZ/ 24BIT HIGH PERFORMANCE ASYNCHRONOUS SRC |
| AK4124VFP | 制造商:Asahi Kasei Microsystems Co Ltd 功能描述: |
| AK4125 | 制造商:AKM 制造商全稱:AKM 功能描述:digital sample rate converter. |
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