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參數(shù)資料
| 型號： | AM1808BZWTA3 |
| 廠商： | Texas Instruments |
| 文件頁數(shù)： | 159/264頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC ARM9 CORTEX MCU 361NFBGA |
| 標準包裝： | 90 |
| 系列： | ARM9 |
| 處理器類型： | ARM 微處理器 |
| 速度： | 375MHz |
| 電壓： | 1.14 V ~ 1.32 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 361-LFBGA |
| 供應商設備封裝： | 361-NFBGA（16x16） |
| 包裝： | 托盤 |
| 其它名稱： | 296-32615 AM1808BZWTA3-ND |
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SPRS653E – FEBRUARY 2010 – REVISED MARCH 2014
6.32 General-Purpose Input/Output (GPIO)
The GPIO peripheral provides general-purpose pins that can be configured as either inputs or outputs.
When configured as an output, a write to an internal register can control the state driven on the output pin.
When configured as an input, the state of the input is detectable by reading the state of an internal
register. In addition, the GPIO peripheral can produce CPU interrupts and EDMA events in different
interrupt/event generation modes. The GPIO peripheral provides generic connections to external devices.
The GPIO pins are grouped into banks of 16 pins per bank (i.e., bank 0 consists of GPIO [0:15]).
The device GPIO peripheral supports the following:
Up to 144 Pins configurable as GPIO
External Interrupt and DMA request Capability
–
Every GPIO pin may be configured to generate an interrupt request on detection of rising and/or
falling edges on the pin.
–
The interrupt requests within each bank are combined (logical or) to create eight unique bank level
interrupt requests.
–
The bank level interrupt service routine may poll the INTSTATx register for its bank to determine
which pin(s) have triggered the interrupt.
–
GPIO Banks 0, 1, 2, 3, 4, 5, 6, 7 and 8 Interrupts assigned to ARM INTC Interrupt Requests 42, 43,
44, 45, 46, 47, 48, 49 and 50 respectively
–
GPIO Banks 0, 1, 2, 3, 4, and 5 are assigned to EDMA events 6, 7, 22, 23, 28, 29, and 29
respectively on Channel Controller 0 and GPIO Banks 6, 7, and 8 are assigned to EDMA events
16, 17, and 18 respectively on Channel Controller 1.
Set/clear functionality: Firmware writes 1 to corresponding bit position(s) to set or to clear GPIO
signal(s). This allows multiple firmware processes to toggle GPIO output signals without critical section
protection (disable interrupts, program GPIO, re-enable interrupts, to prevent context switching to
anther process during GPIO programming).
Separate Input/Output registers
Output register in addition to set/clear so that, if preferred by firmware, some GPIO output signals can
be toggled by direct write to the output register(s).
Output register, when read, reflects output drive status. This, in addition to the input register reflecting
pin status and open-drain I/O cell, allows wired logic be implemented.
The memory map for the GPIO registers is shown in .
Copyright 2010–2014, Texas Instruments Incorporated
Peripheral Information and Electrical Specifications
241
Product Folder Links: AM1808
相關PDF資料 |
PDF描述 |
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| AMM44DRYH | CONN EDGECARD 88POS DIP .156 SLD |
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| HMC20DTEH | CONN EDGECARD 40POS .100 EYELET |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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| AM1808BZWTA4 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:AM1808 ARM Microprocessor |
| AM1808BZWTD3 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:AM1808 ARM Microprocessor |
| AM1808BZWTD4 | 功能描述:微處理器 - MPU ARM MicroProc RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| AM1808BZWTT3 | 制造商:Texas Instruments 功能描述:IC ARM9 CORTEX MPU 361NFBGA 制造商:Texas Instruments 功能描述:AM1808BZWTT3 |
| AM1808EZCE3 | 功能描述:ARM926EJ-S Microprocessor IC Sitara? 1 Core, 32-Bit 375MHz 361-NFBGA (13x13) 制造商:texas instruments 系列:Sitara? 包裝:托盤 零件狀態(tài):有效 核心處理器:ARM926EJ-S 核數(shù)/總線寬度:1 ??，32 位 速度:375MHz 協(xié)處理器/DSP:控制系統(tǒng)；CP15 RAM 控制器:LPDDR，DDR2 圖形加速:無 顯示與接口控制器:LCD 以太網(wǎng):10/100 Mbps（1） SATA:SATA 3Gbps（1） USB:USB 1.1 + PHY（1），USB 2.0 + PHY（1） 電壓 - I/O:1.8V，3.3V 工作溫度:0°C ~ 90°C（TJ） 安全特性:- 封裝/外殼:361-LFBGA 供應商器件封裝:361-NFBGA（13x13） 附加接口:I2C，McASP，McBSP，SPI，MMC/SD，UART 標準包裝:160 |
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