參數資料
| 型號： | APA1000-FGG896I |
| 廠商： | Microsemi SoC |
| 文件頁數： | 160/178頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA PROASIC+ 1M 896-FBGA |
| 標準包裝： | 27 |
| 系列： | ProASICPLUS |
| RAM 位總計： | 202752 |
| 輸入/輸出數： | 642 |
| 門數： | 1000000 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 896-BGA |
| 供應商設備封裝： | 896-FBGA（31x31） |
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ProASICPLUS Flash Family FPGAs
2- 72
v5.9
FIFO Reset
Notes:
1. During reset, either the enables (WRB and RBD) OR the clocks (WCLKS and RCKLS) must be low.
2. The plot shows the normal operation status.
Figure 2-45 FIFO Reset
Table 2-68 TJ = 0°C to 110°C; VDD = 2.3 V to 2.7 V for Commercial/Industrial
TJ = –55°C to 150°C, VDD = 2.3 V to 2.7 V for Military/MIL-STD-883
Symbol txxx
Description
Min.
Max.
Units
Notes
CBRSH1
WCLKS or RCLKS
↑ hold from RESETB ↑
1.5
ns
Synchronous mode only
CBRSS1
WCLKS or RCLKS
↓ setup to RESETB ↑
1.5
ns
Synchronous mode only
ERSA
New EMPTY
↑ access from RESETB ↓
3.0
ns
FRSA
FULL
↓ access from RESETB ↓
3.0
ns
RSL
RESETB low phase
7.5
ns
THRSA
EQTH or GETH access from RESETB
↓
4.5
ns
WBRSH1
WB
↓ hold from RESETB ↑
1.5
ns
Asynchronous mode only
WBRSS1
WB
↑ setup to RESETB ↑
1.5
ns
Asynchronous mode only
Note: During rest, the enables (WRB and RBD) must be high OR the clocks (WCLKS and RCKLS) must be low.
RESETB
EMPTY
EQTH, GETH
FULL
WRB/RBD1
Cycle Start
WCLKS, RCLKS1
tERSA, tFRSA
tTHRSA
tCBRSS
tWBRSS
tCBRSH
tWBRSH
tRSL
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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| APA1000-FGG896M | 制造商:Microsemi Corporation 功能描述:FPGA ProASICPLUS Family 1M Gates 180MHz 0.22um Technology 2.5V 896-Pin FBGA 制造商:Microsemi Corporation 功能描述:FPGA PROASICPLUS 1M GATES 180MHZ 0.22UM 2.5V 896FBGA - Trays |
| APA1000-FGGB | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA1000-FGGES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA1000-FGGI | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA1000-FGGM | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
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