參數(shù)資料
型號(hào): AT32UC3L032-D3UR
廠商: Atmel
文件頁(yè)數(shù): 14/174頁(yè)
文件大?。?/td> 0K
描述: MCU AVR32 32KB FLASH 48TLLGA
標(biāo)準(zhǔn)包裝: 8,000
系列: AVR®32 UC3 L
核心處理器: AVR
芯體尺寸: 32-位
速度: 50MHz
連通性: I²C,SPI,UART/USART
外圍設(shè)備: 欠壓檢測(cè)/復(fù)位,DMA,POR,PWM,WDT
輸入/輸出數(shù): 36
程序存儲(chǔ)器容量: 32KB(32K x 8)
程序存儲(chǔ)器類型: 閃存
RAM 容量: 16K x 8
電壓 - 電源 (Vcc/Vdd): 1.62 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 9x12b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 48-UFLGA
包裝: 帶卷 (TR)
其它名稱: 32UC3L032-D3UR
32UC3L032-D3UR-ND
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110
32099I–01/2012
AT32UC3L016/32/64
9.6
User Interface
The following addresses are used by SAU channel configuration registers. All offsets are relative to the SAU’s PB base
address.
Note:
1.
The reset values are device specific. Please refer to the Module Configuration section at the end of this chapter.
The following addresses are used by SAU channel registers. All offsets are relative to the SAU’s HSB base address. The
number of channels implemented is device specific, refer to the Module Configuration section at the end of this chapter.
Table 9-1.
SAU Configuration Register Memory Map
Offset
Register
Register Name
Access
Reset
0x00
Control Register
CR
Write-only
0x00000000
0x04
Configuration Register
CONFIG
Write-only
0x00000000
0x08
Channel Enable Register High
CERH
Read/Write
0x00000000
0x0C
Channel Enable Register Low
CERL
Read/Write
0x00000000
0x10
Status Register
SR
Read-only
0x00000400
0x14
Interrupt Enable Register
IER
Write-only
0x00000000
0x18
Interrupt Disable Register
IDR
Write-only
0x00000000
0x1C
Interrupt Mask Register
IMR
Read-only
0x00000000
0x20
Interrupt Clear Register
ICR
Write-only
0x00000000
0x24
Parameter Register
PARAMETER
Read-only
0x28
Version Register
VERSION
Read-only
Table 9-2.
SAU Channel Register Memory Map
Offset
Register
Register Name
Access
Reset
0x00
Remap Target Register 0
RTR0
Read/Write
N/A
0x04
Remap Target Register 1
RTR1
Read/Write
N/A
0x08
Remap Target Register 2
RTR2
Read/Write
N/A
...
0x04*n
Remap Target Register n
RTRn
Read/Write
N/A
0xFC
Unlock Register
UR
Write-only
N/A
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