參數(shù)資料
型號(hào)： AT40K40LV-3DQC
廠商： ATMEL CORP
元件分類： FPGA
英文描述： FPGA, 2304 CLBS, 40000 GATES, PQFP208
封裝： PLASTIC, QFP-208
文件頁數(shù)： 18/67頁
文件大?。?/td> 1589K
代理商： AT40K40LV-3DQC
25
AT40K/AT40KLV Series FPGA
0896C–FPGA–04/02
AC Timing Characteristics – 5V Operation AT40K
Delays are based on fixed loads and are described in the notes.
Maximum times based on worst case: VCC = 4.75V, temperature = 70°C
Minimum times based on best case: VCC = 5.25V, temperature = 0°C
Maximum delays are the average of tPDLH and tPDHL.
Cell Function
Parameter
Path
-2
Units
Notes
Core
2-input Gate
tPD (Maximum)
x/y -> x/y
1.8
ns
1 unit load
3-input Gate
t
PD (Maximum)
x/y/z -> x/y
2.1
ns
1 unit load
3-input Gate
t
PD (Maximum)
x/y/w -> x/y
2.2
ns
1 unit load
4-input Gate
t
PD (Maximum)
x/y/w/z -> x/y
2.2
ns
1 unit load
Fast Carry
tPD (Maximum)
y -> y
1.4
ns
1 unit load
Fast Carry
tPD (Maximum)
x -> y
1.7
ns
1 unit load
Fast Carry
tPD (Maximum)
y -> x
1.8
ns
1 unit load
Fast Carry
t
PD (Maximum)
x -> x
1.5
ns
1 unit load
Fast Carry
t
PD (Maximum)
w -> y
2.2
ns
1 unit load
Fast Carry
t
PD (Maximum)
w -> x
2.3
ns
1 unit load
Fast Carry
tPD (Maximum)
z -> y
2.3
ns
1 unit load
Fast Carry
tPD (Maximum)
z -> x
1.7
ns
1 unit load
DFF
tPD (Maximum)
q -> x/y
1.8
ns
1 unit load
DFF
t
PD (Maximum)
R -> x/y
2.2
ns
1 unit load
DFF
t
PD (Maximum)
S -> x/y
2.2
ns
1 unit load
DFF
t
PD (Maximum)
q -> w
1.8
ns
Incremental -> L
tPD (Maximum)
x/y -> L
1.5
ns
1 unit load
Local Output Enable
tPZX (Maximum)
oe -> L
1.4
ns
1 unit load
Local Output Enable
tPXZ (Maximum)
oe -> L
1.8
ns
相關(guān)PDF資料
PDF描述
AT40K40LV-3EQC FPGA, 2304 CLBS, 40000 GATES, PQFP240
AT40K40LV-3FQC FPGA, 2304 CLBS, 40000 GATES, PQFP304
AT40KEL040KW1SB FPGA, 2304 CLBS, 50000 GATES, PQFP160
AT40KEL040KZ1SB FPGA, 2304 CLBS, 50000 GATES, PQFP256
AT89C2051-12SCT/R 8-BIT, FLASH, 12 MHz, MICROCONTROLLER, PDSO20
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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