參數(shù)資料
型號： AT89LP2052-20SU
廠商： Atmel
文件頁數(shù)： 74/94頁
文件大?。?/td> 0K
描述： IC 8051 MCU FLASH 2K 20SOIC
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
標(biāo)準(zhǔn)包裝： 38
系列： 89LP
核心處理器： 8051
芯體尺寸： 8-位
速度： 20MHz
連通性： SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 15
程序存儲器容量： 2KB（2K x 8）
程序存儲器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
包裝： 管件
產(chǎn)品目錄頁面： 616 (CN2011-ZH PDF)
76
3547J–MICRO–10/09
AT89LP2052/LP4052
23.5.4
ISP Exit Sequence
Execute this sequence to exit ISP and resume execution.
1.
Bring SS (P1.4) to “H”.
2.
Tri-state MOSI (P1.5).
3.
Tri-state SCK (P1.7).
4.
Bring RST to “L”.
5.
Tri-state SS.
Figure 23-25. In-System Programming (ISP) Exit Sequence
Note:
The waveforms on this page are not to scale.
23.5.5
ISP Byte Sequence
The ISP byte sequence is shown in Figure 23-26.
Data shifts in/out MSB first.
MISO changes at falling edge of SCK.
MOSI is sampled at rising edge of SCK.
Figure 23-26. ISP Byte Sequence
VCC
RST
SS
SCK
HIGH Z
MOSI
HIGH Z
MISO
XTAL1
7
6
5
4
3
2
1
0
MOSI
MISO
SCK
Data Sampled
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PDF描述
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參數(shù)描述
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