參數(shù)資料
型號： AT90S8515-8AC
廠商： Atmel
文件頁數(shù)： 71/112頁
文件大?。?/td> 0K
描述： IC MCU 8K FLSH 8MHZ 44TQFP
標(biāo)準(zhǔn)包裝： 160
系列： AVR® 90S
核心處理器： AVR
芯體尺寸： 8-位
速度： 8MHz
連通性： SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 32
程序存儲器容量： 8KB（4K x 16）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 512 x 8
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 4 V ~ 6 V
振蕩器型： 內(nèi)部
工作溫度： 0°C ~ 70°C
封裝/外殼： 44-TQFP
包裝： 托盤
61
AT90S8515
0841G–09/01
Default, the external SRAM access, is a 3-cycle scheme as depicted in Figure 43. When
one extra wait state is needed in the access cycle, set the SRW bit (one) in the MCUCR
register. The resulting access scheme is shown in Figure 44. In both cases, note that
PORTA is data bus in one cycle only. As soon as the data access finishes, PORTA
becomes a low-order address bus again.
For details of the timing for the SRAM interface, please refer to Figure 68, Table 37,
view” on page 7 for a description of the memory map, including address space for
SRAM.
Figure 42. External SRAM Connected to the AVR
Figure 43. External Data SRAM Memory Cycles without Wait State
D[7:0]
A[7:0]
A[15:8]
RD
WR
SRAM
DQ
G
Port A
ALE
Port C
RD
WR
AVR
System Clock
ALE
WR
RD
Data/Address [7..0]
Address [15..8]
Address
T1
T2
T3
Prev. Address
Data
Wr
it
e
R
e
a
d
Address
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PDF描述
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