參數資料
型號: ATF1504BE-5AX100
廠商: Atmel
文件頁數: 14/30頁
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描述: IC CPLD 64MC 1.8V 100-TQFP
標準包裝: 90
系列: ATF15xx
可編程類型: 系統(tǒng)內可編程(最少 10,000 次編程/擦除循環(huán))
最大延遲時間 tpd(1): 7.0ns
電壓電源 - 內部: 1.7 V ~ 1.9 V
宏單元數: 64
輸入/輸出數: 80
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 100-TQFP
供應商設備封裝: 100-TQFP(14x14)
包裝: 托盤
配用: ATF15XX-DK3-ND - KIT DEV FOR ATF15XX CPLD'S
21
3637B–PLD–1/08
ATF1504BE
Note:
1. See ordering information for valid part numbers.
2. SSTL is not supported for low drive output (LD).
t
ZX1
Output Buffer Enable Delay
(High Drive; C
L = 35 pF)
V
CCIO = 1.5V
V
CCIO = 1.8V
VCCIO = 2.5V
VCCIO = 3.3V
5.0
4.5
3.5
3.0
6.0
5.5
4.5
4.0
ns
tZX2
Output Buffer Enable Delay
(Low Drive; CL = 35 pF)
VCCIO = 1.5V
VCCIO = 1.8V
V
CCIO = 2.5V
VCCIO = 3.3V
6.0
5.5
4.5
4.0
7.0
6.5
5.5
5.0
ns
t
XZ
Output Buffer Disable Delay (C
L = 5 pF)
4
ns
tSUI
Register Setup Time
1.7
2.2
ns
tHI
Register Hold Time
0.5
0.6
ns
t
FSUI
Register Setup Time of Fast Input
0.5
0.6
ns
tFHI
Register Hold Time of Fast Input
0.5
0.6
ns
tRD
Register Delay
0.7
1.2
ns
t
COMB
Combinatorial Delay
1.2
ns
tIC
Array Clock Delay
1.8
ns
tEN
Register Enable Time
2.5
3
ns
t
GLOB
Global Control Delay
1.8
2
ns
tPRE
Register Preset Time
1.75
2
ns
t
CLR
Register Clear Time
1.75
2
ns
t
UIM
Switch Matrix Delay
0.5
0.8
ns
tSCH
Schmitt Trigger Added Delay
1.5
2
ns
t
SSO
Output Added Delay for V
CCIO Level
(LD)
V
CCIO = 1.5V
VCCIO = 1.8V
V
CCIO = 2.5V
V
CCIO = 3.3V
6.5
5.5
5.25
5
8.5
7.5
7.25
7
ns
SSTL Input Delay Adder (HD)
V
CCIO = 2.5V
V
CCIO = 3.3V
1.5
ns
SSTL2-1_OAD(2)
SSTL3-1_OAD(2)
SSTL Output Delay Adder (HD)
V
CCIO = 2.5V
V
CCIO = 3.3V
1
ns
Table 11-1.
AC Characteristics (Continued)
(1)
Symbol
Parameter
-5
-7
Units
Min
Max
Min
Max
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PDF描述
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