參數(shù)資料
型號： ATF750LVC-15SU
廠商： Atmel
文件頁數(shù)： 17/19頁
文件大?。?/td> 0K
描述： IC CPLD HS 750 GATE 24-SOIC
標(biāo)準(zhǔn)包裝： 31
系列： ATF750LVC
可編程類型： 系統(tǒng)內(nèi)可編程（最少 1K 次編程/擦除循環(huán)）
最大延遲時間 tpd(1)： 15.0ns
電壓電源 - 內(nèi)部： 3 V ~ 5.5 V
宏單元數(shù)： 10
輸入/輸出數(shù)： 10
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 24-SOIC（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 24-SOIC W
包裝： 管件
7
1447F–PLD–11/08
ATF750LVC
16. AC Waveforms, Input Pin Clock(1)
Note:
1. Timing measurement reference is 1.5V. Input AC driving levels are 0.0V and 3.0V, unless otherwise specified.
17. AC Characteristics, Input Pin Clock
Symbol
Parameter
-15 (5V Operation)
-15 (3V Operation)
Units
Min
Max
Min
Max
tPD
Input or Feedback to Non-registered Output
10
15
ns
t
EA
Input to Output Enable
10
15
ns
tER
Input to Output Disable
10
15
ns
t
COS
Clock to Output
0
7
0
10
ns
t
CFS
Clock to Feedback
0
5
0
5.5
ns
tSS
Input Setup Time
5
8
ns
t
SFS
Feedback Setup Time
5
7
ns
t
HS
Hold Time
0
5
ns
tPS
Clock Period
10
14
ns
t
WS
Clock Width
5
7
ns
fMAXS
External Feedback 1/t
SS + tCOS
83
55
MHz
Internal Feedback 1/tSFS + tCFS
100
80
MHz
No Feedback 1/t
PS
100
83
MHz
t
AW
Asynchronous Reset Width
10
15
ns
tARS
Asynchronous Reset Recovery Time
10
15
ns
t
AP
Asynchronous Reset to Registered Output Reset
10
15
ns
t
SPS
Setup Time, Synchronous Preset
5
11
ns
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