參數(shù)資料
型號： ATF750LVC-15SU
廠商： Atmel
文件頁數(shù)： 6/19頁
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描述： IC CPLD HS 750 GATE 24-SOIC
標(biāo)準(zhǔn)包裝： 31
系列： ATF750LVC
可編程類型： 系統(tǒng)內(nèi)可編程（最少 1K 次編程/擦除循環(huán)）
最大延遲時間 tpd(1)： 15.0ns
電壓電源 - 內(nèi)部： 3 V ~ 5.5 V
宏單元數(shù)： 10
輸入/輸出數(shù)： 10
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 24-SOIC（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 24-SOIC W
包裝： 管件
14
1447F–PLD–11/08
ATF750LVC
24. Package Information
24.1
28J – PLCC
2325 Orchard Parkway
San Jose, CA 95131
R
TITLE
DRAWING NO.
REV.
B
28J, 28-lead, Plastic J-leaded Chip Carrier (PLCC)
28J
10/04/01
1.14(0.045) X 45
PIN NO. 1
IDENTIFIER
1.14(0.045) X 45
0.51(0.020)MAX
0.318(0.0125)
0.191(0.0075)
A2
45 MAX (3X)
A
A1
B1
D2/E2
B
e
E1
E
D1
D
COMMON DIMENSIONS
(Unit of Measure = mm)
SYMBOL
MIN
NOM
MAX
NOTE
Notes:
1. This package conforms to JEDEC reference MS-018, Variation AB.
2. Dimensions D1 and E1 do not include mold protrusion.
Allowable protrusion is .010"(0.254 mm) per side. Dimension D1
and E1 include mold mismatch and are measured at the extreme
material condition at the upper or lower parting line.
3. Lead coplanarity is 0.004" (0.102 mm) maximum.
A
4.191
–
4.572
A1
2.286
–
3.048
A2
0.508
–
D
12.319
–
12.573
D1
11.430
–
11.582
Note 2
E
12.319
–
12.573
E1
11.430
–
11.582
Note 2
D2/E2
9.906
–
10.922
B
0.660
–
0.813
B1
0.330
–
0.533
e
1.270 TYP
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