參數資料
型號: ATMEGA645-16AI
廠商: Atmel
文件頁數: 23/85頁
文件大小: 0K
描述: IC AVR MCU FLASH 64K 5V 64TQFP
產品培訓模塊: megaAVR Introduction
標準包裝: 90
系列: AVR® ATmega
核心處理器: AVR
芯體尺寸: 8-位
速度: 16MHz
連通性: SPI,UART/USART,USI
外圍設備: 欠壓檢測/復位,POR,PWM,WDT
輸入/輸出數: 53
程序存儲器容量: 64KB(32K x 16)
程序存儲器類型: 閃存
EEPROM 大?。?/td> 2K x 8
RAM 容量: 4K x 8
電壓 - 電源 (Vcc/Vdd): 2.7 V ~ 5.5 V
數據轉換器: A/D 8x10b
振蕩器型: 內部
工作溫度: -40°C ~ 85°C
封裝/外殼: 64-TQFP
包裝: 托盤
2010-2011 Microchip Technology Inc.
Preliminary
DS41419C-page 247
PIC16(L)F1824/1828
FIGURE 25-4:
SPI MASTER AND MULTIPLE SLAVE CONNECTION
25.2.1 SPI MODE REGISTERS
The MSSP1 module has five registers for SPI mode
operation. These are:
MSSP1 STATUS Register (SSP1STAT)
MSSP1 Control Register 1 (SSP1CON1)
MSSP1 Control Register 3 (SSP1CON3)
MSSP1 Data Buffer Register (SSP1BUF)
MSSP1 Address Register (SSP1ADD)
MSSP1 Shift Register (SSP1SR)
(Not directly accessible)
SSP1CON1 and SSP1STAT are the control and
STATUS registers in SPI mode operation. The
SSP1CON1 register is readable and writable. The
lower 6 bits of the SSP1STAT are read-only. The upper
two bits of the SSP1STAT are read/write.
In SPI master mode, SSP1ADD can be loaded with a
value used in the Baud Rate Generator. More informa-
tion on the Baud Rate Generator is available in
SSP1SR is the shift register used for shifting data in
and out. SSP1BUF provides indirect access to the
SSP1SR register. SSP1BUF is the buffer register to
which data bytes are written, and from which data
bytes are read.
In receive operations, SSP1SR and SSP1BUF
together create a buffered receiver. When SSP1SR
receives a complete byte, it is transferred to SSP1BUF
and the SSP1IF interrupt is set.
During transmission, the SSP1BUF is not buffered. A
write to SSP1BUF will write to both SSP1BUF and
SSP1SR.
SPI Master
SCK
SDO
SDI
General I/O
SCK
SDI
SDO
SS
SPI Slave
#1
SCK
SDI
SDO
SS
SPI Slave
#2
SCK
SDI
SDO
SS
SPI Slave
#3
相關PDF資料
PDF描述
AT80251G2D-3CSUM IC 8051 MCU ROMLESS 40DIP
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參數描述
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