參數(shù)資料
型號： ATTINY24A-SSU
廠商： Atmel
文件頁數(shù)： 92/135頁
文件大?。?/td> 0K
描述： MCU AVR 2K FLASH 20MHZ 14SOIC
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
tinyAVR Introduction
標(biāo)準(zhǔn)包裝： 57
系列： AVR® ATtiny
核心處理器： AVR
芯體尺寸： 8-位
速度： 20MHz
連通性： USI
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 12
程序存儲器容量： 2KB（1K x 16）
程序存儲器類型： 閃存
EEPROM 大小： 128 x 8
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 14-SOIC（0.154"，3.90mm 寬）
包裝： 管件
配用： ATSTK600-RC46-ND - STK600 ROUTING CARD AVR
ATSTK505-ND - ADAPTER KIT FOR 14PIN AVR MCU
MB91470/480 Series
59
(Continued)
*1 : INITX = “L” : Indicates the pin status with INITX remaining at the “L” level.
*2 : INITX = “H” : Indicates the pin status existing immediately after INITX transition from “L” to “H” level.
Pin name
Function
During initialization
In sleep mode
In stop mode
INITX
= “L”*1 INITX = “H”*2
HIZ
= 0HIZ = 1
PD0 to PD3 AN2-8 to AN2-11
Output Hi-Z/
Input disabled
Output Hi-Z/
Input "0" fixed
Retention of the
immediately
prior state
Retention of the
immediately
prior state
Output Hi-Z/
Input “0” fixed
PE0 to PE3
AN3-0 to AN3-3
PE4 to PE7
AN4-0 to AN4-3
PF0
CLKPOUT
Output Hi-Z/
Input disabled
Output Hi-Z/
Input enabled
Retention of the
immediately
prior state
Retention of the
immediately
prior state
Output Hi-Z/
Input “0” fixed
PF1 to PF6
GPIO
PG0, PG3
SCK0, SCK1
Output Hi-Z/
Input disabled
Output Hi-Z/
Input enabled
Retention of the
immediately
prior state
Retention of the
immediately
prior state
Output Hi-Z/
Input “0” fixed
PG1, PG4
SIN0, SIN1
PG2, PG5
SOT0, SOT1
PH0, PH3
SCK2, SCK3
PH1, PH4
SIN2, SIN3
PH2, PH5
SOT2, SOT3
PJ0, PJ2,
PJ4, PJ6
TIN0 to TIN3
Output Hi-Z/
Input disabled
Output Hi-Z/
Input enabled
Retention of the
immediately
prior state
Retention of the
immediately
prior state
Output Hi-Z/
Input “0” fixed
PJ1, PJ3,
PJ5, PJ7
TOUT0 to
TOUT3
PL0
AIN0
Output Hi-Z/
Input disabled
Output Hi-Z/
Input enabled
Retention of the
immediately
prior state
Retention of the
immediately
prior state
Output Hi-Z/
Input “0” fixed
PL1
BIN0
PL2
ZIN0
PM0 to PM3
PPG0 to PPG3
Output Hi-Z/
Input disabled
Output Hi-Z/
Input enabled
Retention of the
immediately
prior state
Retention of the
immediately
prior state
Output Hi-Z/
Input “0” fixed
PP0 to PP3
IC0 to IC3
Output Hi-Z/
Input disabled
Output Hi-Z/
Input enabled
Retention of the
immediately
prior state
Retention of the
immediately
prior state
Output Hi-Z/
Input “0” fixed
PP4
CKI0
PP5
DTTI0
PQ0 to PQ5
RTO0 to RTO5
PR0 to PR3
IC4 to IC7
Output Hi-Z/
Input disabled
Output Hi-Z/
Input enabled
Retention of the
immediately
prior state
Retention of the
immediately
prior state
Output Hi-Z/
Input “0” fixed
PR4
CKI1
PR5
DTTI1
PS0 to PS5
RTO6 to RTO11
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PDF描述
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