參數(shù)資料
型號(hào)： ATWEBDVK-02VOIP
廠商： Atmel
文件頁數(shù)： 46/137頁
文件大?。?/td> 0K
描述： KIT DEV TCP/IP AT89C51RD2 VOIP
標(biāo)準(zhǔn)包裝： 1
系列： @Web
主要目的： *
嵌入式： *
已用 IC / 零件： AT89C51RD2
主要屬性： *
次要屬性： *
已供物品： 板，帶 VoIP 模塊和軟件
產(chǎn)品目錄頁面： 617 (CN2011-ZH PDF)
16
4235K–8051–05/08
AT89C51RD2/ED2
6.2
Functional Block Diagram
Figure 6-1.
Functional Oscillator Block Diagram
6.2.1
Prescaler Divider
A hardware RESET puts the prescaler divider in the following state:
CKRL = FFh: FCLK CPU = FCLK PERIPH = FOSC/2 (Standard C51 feature)
Any value between FFh down to 00h can be written by software into CKRL register in order to
divide frequency of the selected oscillator:
CKRL = 00h: minimum frequency
FCLK CPU = FCLK PERIPH = FOSC/1020 (Standard Mode)
FCLK CPU = FCLK PERIPH = FOSC/510 (X2 Mode)
CKRL = FFh: maximum frequency
FCLK CPU = FCLK PERIPH = FOSC/2 (Standard Mode)
FCLK CPU = FCLK PERIPH = FOSC (X2 Mode)
FCLK CPU and FCLK PERIPH
In X2 Mode, for CKRL<>0xFF:
In X1 Mode, for CKRL<>0xFF then:
Xtal2
Xtal1
Osc
CLK
Idle
CPU Clock
CKRL
Reload
8-bit
Prescaler-Divider
Reset
Peripheral Clock
:2
X2
0
1
F
OSC
CKCON0
CLK
Periph
CPU
CKRL = 0xFF?
0
1
F
CPU
F
=
CLKPERIPH
F
OSC
2
255
CKRL
–
(
)
×
-----------------------------------------------
=
F
CPU
F
=
CLKPERIPH
F
OSC
4
255
CKRL
–
(
)
×
-----------------------------------------------
=
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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