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參數(shù)資料
| 型號： | C164CL |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | 16-Bit Single-Chip Microcontroller |
| 中文描述： | 16位單片機 |
| 文件頁數(shù)： | 69/79頁 |
| 文件大?。?/td> | 1314K |
| 代理商： | C164CL |
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C164CI/SI
C164CL/SL
Data Sheet
65
V2.0, 2001-05
AC Characteristics
Demultiplexed Bus
(Operating Conditions apply)
ALE cycle time = 4 TCL + 2
t
A
+
t
C
+
t
F
(80 ns at 25 MHz CPU clock without waitstates)
Parameter
Symbol
Max. CPU Clock
= 25 MHz
min.
ALE high time
t
5
CC
10 +
t
A
Variable CPU Clock
1 / 2TCL = 1 to 25 MHz
min.
TCL - 10
+
t
A
TCL - 16
+
t
A
TCL - 10
+
t
A
-10
+
t
A
2TCL - 10
+
t
C
3TCL - 10
+
t
C
–
Unit
max.
–
max.
–
ns
Address setup to ALE
t
6
CC
4 +
t
A
–
–
ns
ALE falling edge to RD,
WR (with RW-delay)
ALE falling edge to RD,
WR (no RW-delay)
RD, WR low time
(with RW-delay)
RD, WR low time
(no RW-delay)
RD to valid data in
(with RW-delay)
RD to valid data in
(no RW-delay)
ALE low to valid data in
t
8
CC
10 +
t
A
–
–
ns
t
9
CC
-10 +
t
A
–
–
ns
t
12
CC
30 +
t
C
–
–
ns
t
13
CC
50 +
t
C
–
–
ns
t
14
SR
–
20 +
t
C
2TCL - 20
+
t
C
3TCL - 20
+
t
C
3TCL - 20
+
t
A
+
t
C
4TCL - 30
+
2
t
A
+
t
C
–
ns
t
15
SR
–
40 +
t
C
–
ns
t
16
SR
–
40 +
t
A
+
t
C
50 +
2
t
A
+
t
C
–
–
ns
Address to valid data in
t
17
SR
–
–
ns
Data hold after RD
rising edge
Data float after RD rising
edge (with RW-delay
1)
)
t
18
SR
0
0
ns
t
20
SR
–
26 +
2
t
A
+
t
F1)
–
2TCL - 14
+
22
t
A
+
t
F1)
TCL - 10
+
22
t
A
+
t
F1)
ns
Data float after RD rising
edge (no RW-delay
1)
)
t
21
SR
–
10 +
2
t
A
+
t
F1)
–
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| C164SI | 16-Bit Single-Chip Microcontroller |
| C164SL | 16-Bit Single-Chip Microcontroller |
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| C164SM | 16-Bit Single-Chip Microcontrol ler |
| C164SV | 16-Bit Single-Chip Microcontroller |
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參數(shù)描述 |
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