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參數(shù)資料
| 型號： | C8051F005 |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 45/171頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 8051 MCU 32K FLASH 64TQFP |
| 標(biāo)準(zhǔn)包裝： | 160 |
| 系列： | C8051F00x |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 25MHz |
| 連通性： | SMBus（2 線/I²C），SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，POR，PWM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲(chǔ)器容量： | 32KB（32K x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 2.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x12b，D/A 2x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 64-TQFP |
| 包裝： | 托盤 |
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C8051F000/1/2/5/6/7
C8051F010/1/2/5/6/7
Setting the TR0 bit (TCON.4) enables the timer when either GATE0 (TMOD.3) is 0 or the input signal /INT0 is
logic-level one. Setting GATE0 to logic 1 allows the timer to be controlled by the external input signal /INT0,
facilitating pulse width measurements.
TR0
GATE0
/INT0
Counter/Timer
0
X
Disabled
1
0
X
Enabled
1
0
Disabled
1
Enabled
X = Don’t Care
Setting TR0 does not reset the timer register. The timer register should be initialized to the desired value before
enabling the timer.
TL1 and TH1 form the 13-bit register for Timer 1 in the same manner as described above for TL0 and TH0. Timer
1 is configured and controlled using the relevant TCON and TMOD bits just as with Timer 0.
Figure 19.1. T0 Mode 0 Block Diagram
TL0
(5 bits)
TH0
(8 bits)
GATE0
/INT0
TR0
T0
SYSCLK
12
0
1
0
TCLK
TCON
TF0
TR0
TR1
TF1
IE1
IT1
IE0
IT0
Interrupt
CKCON
T
2
M
T
1
M
T
0
M
TMOD
T
1
M
1
T
1
M
0
C
/
T
1
G
A
T
E
1
G
A
T
E
0
C
/
T
0
T
0
M
1
T
0
M
0
Crossbar
19.1.2. Mode 1: 16-bit Counter/Timer
Mode 1 operation is the same as Mode 0, except that the counter/timer registers use all 16 bits. The counter/timers
are enabled and configured in Mode 1 in the same manner as for Mode 0.
139
Rev. 1.7
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| C8051F000 | IC 8051 MCU 32K FLASH 64TQFP |
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參數(shù)描述 |
|---|---|
| C8051F005/0046 | 制造商:Silicon Laboratories Inc 功能描述: |
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