參數(shù)資料
型號： C8051F305-GS
廠商： Silicon Laboratories Inc
文件頁數(shù)： 176/178頁
文件大小： 0K
描述： IC 8051 MCU 2K FLASH 14-SOIC
產(chǎn)品培訓(xùn)模塊： Serial Communication Overview
標準包裝： 56
系列： C8051F30x
核心處理器： 8051
芯體尺寸： 8-位
速度： 25MHz
連通性： SMBus（2 線/I²C），UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 8
程序存儲器容量： 2KB（2K x 8）
程序存儲器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.6 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 14-SOIC（0.154"，3.90mm 寬）
包裝： 管件
產(chǎn)品目錄頁面： 622 (CN2011-ZH PDF)
配用： 336-1444-ND - ADAPTER PROGRAM TOOLSTICK F300
其它名稱： 336-1540-5
Rev. 2.9
97
C8051F300/1/2/3/4/5
11. Oscillators
C8051F300/1/2/3/4/5 devices include a programmable internal oscillator and an external oscillator drive
circuit. The internal oscillator can be enabled/disabled and calibrated using the OSCICN and OSCICL reg-
isters, as shown in Figure 11.1. The system clock can be sourced by the external oscillator circuit, the
internal oscillator, or a scaled version of the internal oscillator. The internal oscillator's electrical specifica-
tions are given in Table 11.1 on page 99.
OSC
Programmable
Internal Clock
Generator
Input
Circuit
EN
SYSCLK
n
OSCICL
OSCICN
IFRDY
C
L
KSL
IOSC
EN
IFCN1
IFCN0
XTAL1
XTAL2
Option 2
VDD
XTAL2
Option 1
10M
Option 3
XTAL2
Option 4
XTAL2
OSCXCN
XT
LVLD
XO
SC
M
D
2
XO
SC
M
D
1
XO
SC
M
D
0
X
F
CN2
X
F
CN1
X
F
CN0
Figure 11.1. Oscillator Diagram
11.1. Programmable Internal Oscillator
All C8051F300/1/2/3/4/5 devices include a programmable internal oscillator that defaults as the system
clock after a system reset. The internal oscillator period can be adjusted via the OSCICL register as
defined by SFR Definition 11.1. On C8051F300/1 devices, OSCICL is factory calibrated to obtain a
24.5 MHz frequency. On C8051F302/3/4/5 devices, the oscillator frequency is a nominal 20 MHz and may
vary ±20% from device-to-device.
Electrical specifications for the precision internal oscillator are given in Table 11.1 on page 99. The pro-
grammed internal oscillator frequency must not exceed 25 MHz. Note that the system clock may be
derived from the programmed internal oscillator divided by 1, 2, 4, or 8, as defined by the IFCN bits in reg-
ister OSCICN. The divide value defaults to 8 following a reset.
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