參數(shù)資料
型號： C8051F353-GMR
廠商： Silicon Laboratories Inc
文件頁數(shù)： 217/234頁
文件大?。?/td> 0K
描述： IC 8051 MCU 8K FLASH 28MLP
產(chǎn)品培訓(xùn)模塊： Serial Communication Overview
標(biāo)準(zhǔn)包裝： 1,500
系列： C8051F35x
核心處理器： 8051
芯體尺寸： 8-位
速度： 50MHz
連通性： SMBus（2 線/I²C），SPI，UART/USART
外圍設(shè)備： POR，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 17
程序存儲器容量： 8KB（8K x 8）
程序存儲器類型： 閃存
RAM 容量： 768 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x16b; D/A 2x8b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-VFQFN 裸露焊盤
包裝： 帶卷 (TR)
配用： 336-1083-ND - DEV KIT FOR F350/351/352/353
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Rev. 1.1
83
C8051F350/1/2/3
9.1.
Comparator0 Inputs and Outputs
Figure 9.3 shows the external pin connections for the comparator. The positive and negative inputs to the
comparator can each be routed to one of eight different pins using the comparator mux. Comparator out-
puts can optionally be routed to port pins using the Crossbar circuitry.
The comparator inputs (CP0+ and CP0–) are selected in the CPT0MX register (SFR Definition 9.3). The
CMX0P1–CMX0P0 bits select the comparator’s positive input; the CMX0N1–CMX0N0 bits select the com-
parator’s negative input. Important Note About Comparator Inputs: The Port pins selected as compara-
tor inputs should be configured as analog inputs in their associated Port configuration register, and
configured to be skipped by the Crossbar.
Two versions of the comparator output can be routed to port pins, using the Port I/O Crossbar. The raw
(asynchronous) comparator output CP0A is enabled using bit 5 in the XBR0 register, and will be available
at P1.4. The CP0 output (synchronized to SYSCLK) is available at P1.5 when it is enabled with bit 4 in the
XBR0 register.
Figure 9.3. Comparator Pin Connections
VDD
+
-
Q
SET
CLR
D
Q
SET
CLR
D
(SYNCHRONIZER)
GND
CP0 +
CP0 -
CP0
CP0A
P1.5
P1.4
0
1
0
1
XBR0
CP
0
E
CP
0
A
E
P0.0
P0.2
P0.4
P0.6
P0.1
P0.3
P0.5
P0.7
P1.0
P1.2
P1.4
P1.6
P1.1
P1.3
P1.5
P1.7
CPT0MX
CM
X
0
N3
CM
X
0
N2
CM
X
0
N1
CM
X
0
N0
C
M
X0
P3
C
M
X0
P2
C
M
X0
P1
C
M
X0
P0
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PDF描述
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