參數(shù)資料
型號： C8051F713-GQ
廠商： Silicon Laboratories Inc
文件頁數(shù)： 178/306頁
文件大?。?/td> 0K
描述： IC 8051 MCU 8K FLASH 48-TQFP
產(chǎn)品培訓模塊： Serial Communication Overview
特色產(chǎn)品： QuickSense? Portfolio
C8051F7xx Series
標準包裝： 250
系列： C8051F71x
核心處理器： 8051
芯體尺寸： 8-位
速度： 25MHz
連通性： SMBus（2 線/I²C），SPI，UART/USART
外圍設備： 電容感應，POR，PWM，WDT
輸入/輸出數(shù)： 39
程序存儲器容量： 8KB（8K x 8）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 32 x 8
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 3.6 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 48-TQFP
包裝： 托盤
產(chǎn)品目錄頁面： 624 (CN2011-ZH PDF)
配用： 336-1635-ND - DEV KIT FOR C8051F700
其它名稱： 336-1615
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Rev. 1.0
259
C8051F70x/71x
SFR Address = 0x98; SFR Page = All Pages; Bit-Addressable
SFR Definition 32.1. SCON0: Serial Port 0 Control
Bit
76543210
Name
S0MODE
MCE0
REN0
TB80
RB80
TI0
RI0
Type
R/W
R
R/W
Reset
01000000
Bit
Name
Function
7S0MODE Serial Port 0 Operation Mode.
Selects the UART0 Operation Mode.
0: 8-bit UART with Variable Baud Rate.
1: 9-bit UART with Variable Baud Rate.
6
Unused
Read = 1b, Write = Don’t Care.
5MCE0
Multiprocessor Communication Enable.
The function of this bit is dependent on the Serial Port 0 Operation Mode:
Mode 0: Checks for valid stop bit.
0: Logic level of stop bit is ignored.
1: RI0 will only be activated if stop bit is logic level 1.
Mode 1: Multiprocessor Communications Enable.
0: Logic level of ninth bit is ignored.
1: RI0 is set and an interrupt is generated only when the ninth bit is logic 1.
4REN0
Receive Enable.
0: UART0 reception disabled.
1: UART0 reception enabled.
3TB80
Ninth Transmission Bit.
The logic level of this bit will be sent as the ninth transmission bit in 9-bit UART Mode
(Mode 1). Unused in 8-bit mode (Mode 0).
2RB80
Ninth Receive Bit.
RB80 is assigned the value of the STOP bit in Mode 0; it is assigned the value of the
9th data bit in Mode 1.
1TI0
Transmit Interrupt Flag.
Set by hardware when a byte of data has been transmitted by UART0 (after the 8th bit
in 8-bit UART Mode, or at the beginning of the STOP bit in 9-bit UART Mode). When
the UART0 interrupt is enabled, setting this bit causes the CPU to vector to the UART0
interrupt service routine. This bit must be cleared manually by software.
0RI0
Receive Interrupt Flag.
Set to 1 by hardware when a byte of data has been received by UART0 (set at the
STOP bit sampling time). When the UART0 interrupt is enabled, setting this bit to 1
causes the CPU to vector to the UART0 interrupt service routine. This bit must be
cleared manually by software.
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PDF描述
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C8051F714-GM 功能描述:8位微控制器 -MCU 8kB ADC Cap Sense RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT
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