參數(shù)資料
型號(hào)： CXP84720
廠商： Sony Corporation
英文描述： CMOS 8-bit Single Chip Microcomputer
中文描述： 的CMOS 8位單片機(jī)
文件頁(yè)數(shù)： 21/29頁(yè)
文件大小： 406K
代理商： CXP84720
Note 1)
t
sys indicates three values according to the contents of the clock control register (CLC: 00FE
h
) upper
2 bits (CPU clock selection).
t
sys [ns] = 2000/fc (upper 2 bits = “00”), 4000/fc (upper 2 bits = “01”), 16000/fc (upper 2 bits = “11”)
Note 2)
CS, SCK, SI and SO represent CS0, SCK0, SI0 and SO0 for CH0; they represent CS1, SCK1, SI1
and SO1 for CH1, respectively.
Note 3)
The load of SCK output mode and SO output delay time is 50pF.
– 21 –
CXP84716/84720/84724
Serial transfer (CH0, CH1)
(Ta = –20 to +75°C, V
DD
= 3.0 to 3.6V, Vss = 0V reference)
CS
↓ →
SCK
delay time
CS
↑ →
SCK
floating delay time
CS
↓ →
SO delay time
CS
↑ →
SO floating
delay time
CS High level width
t
sys + 200
2
t
sys + 200
8000/fc
t
sys + 100
4000/fc – 100
–
t
sys + 100
200
2
t
sys + 200
100
1.5
t
sys + 250
1.5
t
sys + 200
1.5
t
sys + 250
1.5
t
sys + 200
2
t
sys + 250
125
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Item
Symbol
Pin
Conditions
Min.
Max.
Unit
Chip select transfer mode
(SCK = output mode)
Chip select transfer mode
(SCK = output mode)
Chip select transfer mode
Chip select transfer mode
Chip select transfer mode
Input mode
Output mode
Input mode
Output mode
SCK input mode
SCK output mode
SCK input mode
SCK output mode
SCK input mode
SCK output mode
SCK cycle time
SCK High and Low
level widths
SI input setup time
(for SCK
↑
)
SI input hold time
(for SCK
↑
)
SCK
↓ →
SO
delay time
t
DCSK
t
DCSKF
t
DCSO
t
DCSOF
t
WHCS
t
KCY
t
KH
t
KL
t
SIK
t
KSI
t
KSO
SCK0
SCK1
SCK0
SCK1
SO0
SO1
SO0
SO1
CS0
CS1
SCK0
SCK1
SCK0
SCK1
SI0
SI1
SI0
SI1
SO0
SO1
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PDF描述
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