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參數(shù)資料
| 型號(hào)： | CY39100V388B-83MGXC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | LOADABLE PLD, 15 ns, PBGA388 |
| 封裝： | 35 X 35 MM, 1.27 MM PITCH, LEAD FREE, BGA-388 |
| 文件頁數(shù)： | 18/86頁 |
| 文件大?。?/td> | 2677K |
| 代理商： | CY39100V388B-83MGXC |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *I
Page 25 of 86
Registered Output with Synchronous Clocking (Macrocell)
Registered Input in I/O Cell
Clock to Clock
PT Clock to PT Clock
Switching Waveforms (continued)
tMCS
INPUT
SYNCHRONOUS
tMCCO
REGISTERED
OUTPUT
tMCH
CLOCK
tIOS
DATA
INPUT
INPUT REGISTER
CLOCK
tIOCO
REGISTERED
OUTPUT
tIOH
INPUT REGISTER
CLOCK
MACROCELL
REGISTER CLOCK
tSCS
tICS
DATA
PT CLOCK
tSCS2PT
tMCSPT
INPUT
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY39200V208-125NTXC | LOADABLE PLD, 10 ns, PQFP208 |
| CY39050V208-125NTXC | LOADABLE PLD, 10 ns, PQFP208 |
| CY39050V208-125NTXI | LOADABLE PLD, 10 ns, PQFP208 |
| CY39050V208-233NTXC | LOADABLE PLD, 7.2 ns, PQFP208 |
| CY39050V208-83NTXC | LOADABLE PLD, 15 ns, PQFP208 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY39100V484-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39100V484-125BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39100V484-125BGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39100V484-125BGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39100V484-125MBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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