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參數(shù)資料
| 型號： | CY7C0853AV-133BBC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | SRAM |
| 英文描述： | FLEx36™ 3.3V 32K/64K/128K/256K x 36 Synchronous Dual-Port RAM |
| 中文描述： | 256K X 36 DUAL-PORT SRAM, 4.7 ns, PBGA172 |
| 封裝： | 15 X 15 MM, 1.25 MM HEIGHT, 1 MM PITCH, FBGA-172 |
| 文件頁數(shù)： | 9/36頁 |
| 文件大?。?/td> | 956K |
| 代理商： | CY7C0853AV-133BBC |
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CY7C0850AV,CY7C0851V/CY7C0851AV
CY7C0852V/CY7C0852AV
CY7C0853V/CY7C0853AV
Document #: 38-06070 Rev. *J
Page 17 of 36
JTAG Timing
Parameter
Description
167/133/100
Unit
Min
Max
fJTAG
Maximum JTAG TAP controller frequency
–
10
MHz
tTCYC
TCK clock cycle time
100
–
ns
tTH
TCK clock HIGH time
40
–
ns
tTL
TCK clock LOW Time
40
–
ns
tTMSS
TMS setup to TCK clock rise
10
–
ns
tTMSH
TMS hold after TCK clock rise
10
–
ns
tTDIS
TDI setup to TCK clock rise
10
–
ns
tTDIH
TDI hold after TCK clock rise
10
–
ns
tTDOV
TCK clock LOW to TDO valid
–
30
ns
tTDOX
TCK clock LOW to TDO invalid
0
–
ns
Figure 7. JTAG Switching Waveform
Test Clock
Test Mode Select
TCK
TMS
Test Data-In
TDI
Test Data-Out
TDO
tTCYC
tTMSH
tTL
tTH
tTMSS
tTDIS
tTDIH
tTDOX
tTDOV
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